点滴1：添加chipscope：1.使用ip核添加，例化IP核。2.使用CDC添加，添加New source-（小钥匙），添加完成后双击打开。3.打开chipscope core insert（软件），选择需要插入的工程。点滴2：ICON：每一个ILA和VIO都需要与ICON连接，有几个ILA/VI...
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2014-11-15 21:30:34
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在做12864 ip 核试验时，写了三个文件第一个是时序文件QC12864.v第二个是QC12864.H这个文件主要包括声明和宏定义，第三个文件是QC12864.c这个文件包含函数的定义。详细的请看http://www.cnblogs.com/yuphone/archive/2010/03/25/1...
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2014-10-13 00:49:08
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1、关于Qsys的指令总线和数据总线连接的问题（data_master和instruction_master）关于数据和指令端口的连接的疑问，这是初用Qsys的童鞋们很困惑的问题，之前使用SOPC Builder建立Nios II时并不手动连接这些端口。对于一个添加的IP核来说什么时候连接数据端口，...
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2014-08-28 11:08:39
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这次用到网上下载的一个12.0版本的ip核，使用qsys做的，而我的开发环境是10.1的，sopc是用的sopcbuilder做的，下载下来的ip核添加新组建后，会报错，采取的做法是对比我的10.1版本的ip核，发现tcl文件几个地方需要改一下就可以用了。1.set_module_property ...
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2014-08-11 20:42:52
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昨晚用modelsim仿真ROM,居然输出的数据全部都是000.这个在以前是没有过的.难道modelsim坏了?我试了一个以前的rom测试文件,居然显示正常.这就怪了.难道2个月没碰就这么生疏了?然后开始找原因.最后看到一个帖子说,如果rom无输出,可能是IP核配置文件的,初始化文件需要使用绝对路径...
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2014-08-10 10:21:00
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官方文档http://www.xilinx.com/support/documentation/application_notes/xapp890-zynq-sobel-vivado-hls.pdf 准备工作 下载 工程文件 http://pan.baidu.com/s/1eQqwjBk 这是我用百...
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2014-07-25 02:35:14
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今天为了熟悉axiLite的自定义ip核设计， 把LED和SW的往AXI总线输入输出定义在一个ip核中， BD设计如下： ip核顶层文件（增加了LED_Out和SW_In的定义）mygpio_v1.0.v： module mygpio_v1_0 # ( // Users to add paramet...
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2014-06-18 17:36:35
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最近在关注的问题是怎么样从ps端丢数据到ram， 然后用ip核进行处理后再输送到ram，ps端可以读取。 参考文献：【OpenHW参赛手记】AXI-Stream接口开发详细流程 首先按照作者的探索思路在 VIVADO 2013.4 下实践了一下AXI-Stream-FIFO bd: standalo...
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2014-06-18 10:03:50
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