%算法 p188%例题 p209clc;clear;A=[1 0.4 0.4 0.4 1 0.8 0.4 0.8 1];b=[ 1 2 3];%迭代四次height=size(A,1);D=diag(diag(A));L=tril(A,-1);%得到LU=triu(A,1);%得到U% x=[1 ; ...
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2018-05-31 22:03:59
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id='441900199908060015' sex=id[-2] print('性别') if (int(sex)%2==0): print('gril') else: print('boy') for i in range (12): print(9800+i,chr(9800+i)) b =... ...
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2018-05-23 22:05:25
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一、引子 缓存有很多种解决方案，常见的是： 1.存储在内存中 : 内存缓存顾名思义直接存储在JVM内存中，JVM宕机那么内存丢失，读写速度快，但受内存大小的限制，且有丢失数据风险。 2.存储在磁盘中: 即从内存落地并序列化写入磁盘的缓存，持久化在磁盘，读写需要IO效率低，但是安全。 3.内存+磁盘组 ...
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2018-05-23 20:35:31
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I'm sorry but I don't want to be an Emperor - that's not my business - I don't want to rule or conquer anyone. I should like to help everyone if possi ...
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2018-05-18 00:21:52
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本想第一章就将导论一起写完，但是总觉得对一些重要的概念还是想以小篇幅的形式突出重点写出来，所以接下来的这篇文章就是对上篇文章的延续。 1.6 随机化对象 以一个初入验证领域的人来讲，所谓的随机化就是 数据字段 ，这种激励最容易创建 只需要调用$random()函数即可。但是这种随机数据在找漏洞方面的 ...
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2018-05-08 11:16:26
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在ubuntu apt-get upgrade的时候，遇到： E: Could not get lock /var/cache/ apt/archives/lock - open (11 Resource temporarily unavailable)E: Unable to lock the d ...
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2018-05-01 14:02:13
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Chapter Review 1 An entry condition loop evaluates a test expression before entering the body of the loop. If the condition is initially , the loop ne ...
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2018-04-29 15:29:11
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在使用Verilog进行设计过程中，经常会遇到某些条件判断语句中的分支没有执行，有些for循环仅执行一次的情况，特别是在过程性赋值语句中。其中很大一部分是因为错误使用了“；”导致的。因为Verilog源自C语言，根据其语言特性，“；”在Verilog中本身是一条单独的空语句，只是岂不进行任何具体操作 ...
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2018-04-29 01:30:21
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【问题描述】 在使用Verilog对硬件逻辑进行建模和模拟的同时，必须理解代码与硬件实现的联系和Verilog语言本身的语法规则，如果对于这些理解不够，往往会造成代码调试周期延长，更有甚者造成电路逻辑功能异常的情况出现，从而拖延电路设计的周期。本文列举的错误不仅初学者经常遇到，在一些经验丰富的电路设 ...
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2018-04-22 10:50:54
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import time 一、时间获取函数 time()， ctime()，gmtime() 二、时间格式化 strftime(tpl, ts) tpl是时间格式化模板字符串，用来定义输出效果，ts是计算机内部时间类型变量。 举例如下： 如果strftime没有第二个参数，则默认获取当前时间。 str ...
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2018-04-21 19:44:06
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