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搜索关键字:晶振    ( 281个结果
51定时器初值的计算
1Hz:1秒内电流往返一次 晶振 11.0592MHz =11059200Hz 时钟周期 1/11059200 s(晶振的倒数) 机器周期是 12/11059200 s (标准框架下51单片机一个机器是12个时钟周期) 因为定时器是每个机器周期加1所以定时时间为 N*时钟机器周期时间=所定时间T 所 ...
分类:其他好文   时间:2016-07-02 21:30:31    阅读次数:242
新建工程---寄存器版
目前学习STM32最流行的方法是使用固件库!!(暂时使用寄存器版本) systemInit函数的作用是把外部晶振经过锁相环使系统时钟变成180MHZ。(在固件库版本里面实现了的)。 可以在main.c文件里面实现systemInit函数,不过没有函数体;主要是使编译时不报错;如果我们没有实现这个函数 ...
分类:其他好文   时间:2016-07-02 13:06:02    阅读次数:131
《FPGA全程进阶---实战演练》第五章 基于74HC595的LED操作
1基础理论部分 分频,是的,这个概念也很重要。分频是指将一单一频率信号的频率降低为原来的1/N,就叫N分频。实现分频的电路或装置称为“分频器”,如把33MHZ的信号2分频得到16.5MHZ的信号,3分频得到11MHZ的信号,10分频得到3.3MHZ的信号。 分频主要是相对于主晶振来说,用不到那么高的 ...
分类:其他好文   时间:2016-07-01 21:26:00    阅读次数:241
嵌入式学习-uboot-lesson6-时钟初始化
1 6410时钟体系 从上图以及原理图可以知道下面的内容: 1.采用12M的晶振 2 有三个分频器 APLL MPLL EPLL 3.产生了四个时钟 ACLK HCLK PCLK SCLK 下面是几个时钟的应用范围: 其中ACLK为系统时钟,HCLK和PCLK为各种外设和内部的时钟,SCLK暂且不考虑2时钟初始化过程从上图可以看出,SYSCLK为系统时钟,起初频率为12MHZ,...
分类:其他好文   时间:2016-06-29 11:27:14    阅读次数:503
STM32的时钟树深入详解以及RCC配置
在STM32上如果不使用外部晶振,OSC_IN和OSC_OUT的接法 如果使用内部RC振荡器而不使用外部晶振,请按照下面方法处理: 1)对于100脚或144脚的产品,OSC_IN应接地,OSC_OUT应悬空。2)对于少于100脚的产品,有2种接法: 2.1)OSC_IN和OSC_OUT分别通过10K ...
分类:其他好文   时间:2016-06-26 22:36:02    阅读次数:258
STM32F4_RCC系统时钟配置及描述
Ⅰ、概述 对于系统时钟应该都知道它的作用,就是驱动整个芯片工作的心脏,如果没有了它,就等于人没有了心跳。 对于使用开发板学习的朋友来说,RCC系统时钟这一块知识估计没怎么去配置过,原因在于开发板提供的晶振基本上都是官方标准的时钟频率,使用官方的标准库,这样系统时钟就是默认的配置,也就是默认的频率。但 ...
分类:其他好文   时间:2016-06-23 12:40:57    阅读次数:303
有源晶振和无源晶振
有源晶振与无源晶振的比较 无源晶振:就是一个晶体,本身不能振荡,依靠配合其他IC内部振荡电路工作。 有源晶振:晶体+振荡电路,封装在一起。给他供上电源,就有波形输出。。。 1、无源晶体——无源晶体需要用DSP片内的振荡器,在datasheet上有建议的连接方法。无源晶体没有电压的问题,信号电平是可变 ...
分类:其他好文   时间:2016-06-02 11:35:02    阅读次数:152
用了这几条单片机控制板的设计原则,老板都为你点赞!
单片机控制板在设计过程中,如果你能够遵循下面的几个原则,老板一定为你点赞!(1)在元器件的布局方面,应该把相互有关的元件尽量放得靠近一些,例如,时钟发生器、晶振、CPU的时钟输入端都易产生噪声,在放置的时候应把它们靠近些。对于那些易产生噪声的器件、小电流电路、大..
分类:其他好文   时间:2016-05-23 19:20:23    阅读次数:133
用定时器令P0(或其它IO口)产生多路方波
void Timer0_isr(void) interrupt 1 using 1{ static unsigned char i; //重新赋值 12M晶振计算,指令周期1uS,500x2=1mS方波 TH0=(65536-500)/256; TL0=(65536-500)%256; i++; P ...
分类:其他好文   时间:2016-05-20 22:18:36    阅读次数:176
基于FPGA的飞机的小游戏
基于FPGA的飞机的小游戏 实验原理 该实验主要分为4个模块,采用至上而下的设计方法进行设计。由50M的晶振电路提供时钟源,VGA显示控制模块、图形显示控制模块、移动模块的时钟为25M,由时钟分频电路产生获得。时钟分频模块采用PLL进行设计,由50M时钟进行2分频获得25M时钟。 移动模块,控制我方... ...
分类:其他好文   时间:2016-05-06 20:30:23    阅读次数:395
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