【黑金原创教程】【FPGA那些事儿-驱动篇I 】实验四：按键模块③ — 单击与双击
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2014-06-29 00:13:04
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1. 如果是从未使用过USB外接设备的，需要查看CMOS参数 对于从来没有使用过USB外接设备的朋友来说，即使正确安装了驱动程序也有可能出现系统无法检测USB硬盘的情况，这主要是由于主板默认的CMOS端口是关闭的，如果没有将其设置为开启状态，那么Windows自然无法检测到移动硬盘了。为了解决这个问...
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2014-06-18 22:10:25
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上一篇说了下usb camera uvc标准的 顺便把CMOS做到一起 操作上基本一至 上一篇HAL层里我已经提供了CMOS的相关接口
JNIEXPORT jint JNICALL Java_com_dao_usbcam_Fimcgzsd_yuvtorgb
如果使用和UVC一样的处理 图像显示不出来 所以用另外一种方法 同时这里使用的是斯道ICOOL210开发板测试的 如果使用CMOS...
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2014-06-15 16:52:53
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自动生成Tcl文件
Project -> Generate Tcl File for Project...
弹出如下对话框，设置脚本路径。
编辑引脚
使用set_location_assignment分配管脚如下：
第一次配制时，没有set_location_assignment语句，自已在set_global_assignment语句下一行添加即可。
...
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2014-06-15 08:49:23
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第六章 时钟域有一个有趣的现象，众多数字设计特别是与FPGA设计相关的教科书都特别强调整个设计最好采用唯一的时钟域。换句话说，只有一个独立的网络可以驱动一个设计中所有触发器的时钟端口。虽然这样可以简化时序分析以及减少很多与多时钟域有关的问题，但是由于FPG**外各种系统限制，只使用一个时钟常常又不现...
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2014-06-14 18:27:15
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1 性能比较TTL电路与CMOS电路连接1 反相器电路解法一边接电流源一边接地2 上啦电阻R，使得前级门截止的时候使得输出高电平更接近于电源电压此时TTL和CMOS电源电压不相等，并且TTL电路选择OC门电路
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2014-06-14 08:42:13
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说明
本文基于FPGA和CPLD器件，采用非流水线和流水线技术实现8位加法器，并对比其Quartus II仿真结果和波形时序。 器件选择：
Stratix：EP1S40F1020C5(FPGA) MAX7000S：EPM7064SLC44-5(CPLD)实验一 FPGA实现8位加法器 程序...
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2014-06-13 20:12:24
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DIP中文解释：双列直插式封装。插装型封装之一，引脚从封装两侧引出，封装材料有塑料和陶瓷两种。DIP是最普及的插装型封装，应用范围包括标准逻辑IC，存贮器LSI，微机电路等。
PLCC中文解释:外形呈正方形，32脚封装，四周都有管脚，外形尺寸比DIP封装小得多。PLCC封装适合用SMT表面安装技术在...
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2014-06-13 17:46:35
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