硬件平台：DE2-115 软件环境：Quartus II 15.1 采样了较为简单的计数方法，详细代码就不讲解了，分为三个模块，一个是计数模块 count.v，一个是显示模块 disp.v，还有一个是顶层模块 miaobiao.v。有清零按键和暂停拨码开关。 顶层模块： 1 module miaob ...
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2019-10-06 00:17:56
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写在前面的话 在这里梦翼师兄想特地强调一下Modelsim 这个软件，那么这个软件到底是做什么的呢？在这里，我问大家一个问题，假设我们有一块硬件电路板设计完成以后，不知道功能是否正常，那么我们需要怎么做呢？答案很简单的啦，就是我们所谓的“测试”，给电路板上电以后，输入一定的测试激励，观察电路板有什么 ...
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2019-09-12 19:49:56
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FPGA面试题——网上资料整理 2019-08-23 21:22:30 1：什么是同步逻辑和异步逻辑？（汉王） FPGA面试题——网上资料整理 2019-08-23 21:22:30 1：什么是同步逻辑和异步逻辑？（汉王） 同步逻辑是时钟之间有固定的因果关系。 异步逻辑是各时钟之间没有固定的因果关系 ...
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2019-08-23 22:49:12
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首先 然后填充好自己写的代码 之后save as 存到自己的文件夹 会自动弹出 配置 Assignments settings 之后第一次编译 成功后processing start start testbench template writer 之后去保存的文件下，下面有一个simulation文 ...
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2019-07-02 00:24:34
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在modelSIM的wave界面，按Ctrl + S，可以保存.do文件，里面有显示波形的命令，结合其他指令，可以协助Quartus进行仿真。 Quartus的工程设置中，EDA Tool Setting ->Simulation ->NativeLink Settings允许指定.do或者.tcl ...
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2019-03-29 19:03:50
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本实验使用DE1器件，cyloneV，主要做的基础实验，目的是回顾前期的学习和巩固知识和熟悉操作流程。 初学者FPGA开发流程： 1、设计定义; 2、设计输入；（quartus II） 3、语法检测，分析和综合（quartus II检查）； 4、功能仿真；（modelsim-altera仿真） 5、 ...
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2019-02-21 13:03:48
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因调试需要，进行后仿真，ISE生成的sim文件和sdf文件 SDF文件 顶层仿真文件 do文件 Modelsim仿真波形如下 ...
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2018-12-19 13:20:54
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在学习时序逻辑的时候,我们明白寄存器赋值总有一拍的延迟但是有的时候仿真的时候会发现会没有延迟，比如下面这段代码对应的modelsim仿真。 源代码代码如下： 测试激励如下： 仿真截图如下： 2.从仿真截图可以看出work_flag与se_flag几乎是同时拉高的，那么造成这个现象的原因是什么呢？ 对 ...
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2018-12-08 22:38:03
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以前在使用ModelSim进行仿真的时候，一直是使用其GUI进行操作的，但是这样很繁琐也很费时。故希望学习其自动化仿真do文件，下面是学习的一些总结。 以前在使用ModelSim进行仿真的时候，一直是使用其GUI进行操作的，但是这样很繁琐也很费时。故希望学习其自动化仿真do文件，下面是学习的一些总结 ...
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2018-12-02 10:28:03
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reference:https://www.cnblogs.com/bettty/p/5285785.html Abstract 本文介绍UVM框架，并以crc7为例进行UVM的验证，最后指出常见的UVM验证开发有哪些坑，以及怎么避免。 Introduction 本例使用环境：ModelSim 10 ...
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2018-12-02 10:27:14
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