对于FPGA的开发而言，除了需要安装Quartus II软件外，还需要安装USB Blaster下载器。USB Blaster下载器为Altera的FPGA/CPLD程序下载电缆，通过计算机的USB接口可对Altera的FPGA/CPLD以及配置芯片进行编程、调试等操作。USB-Blaster下载器...
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2014-12-31 21:25:13
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具体做法如下：1打开一个已经分配好引脚的DE2工程，应该选择使用引脚比较多的DE2工程， 比如DE2演示光盘上的DE2_Top。2点击Assignments 菜单下的Pins 菜单项， 打开引脚分配界面， 点击File菜单下的Export菜单项，打开引脚导出对话框， 选择导出文件类型为Tcl。3在一...
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2014-12-23 21:04:53
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这篇文章不需要在modelsim中建库、映射、建工程等一些繁琐的步骤，直接使用modelsim中的默认work库。使用quartus+modelsim联合仿真。首先推荐一篇文章http://www.cnblogs.com/emouse/archive/2012/07/08/2581223.html首...
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2014-12-17 22:21:32
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Windows版本必装组件：QuartusIIhttp://download.altera.com/akdlm/software/acdsinst/14.0/200/ib_installers/QuartusSetup-14.0.0.200-windows.exe 1.45GBhttp://down...
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2014-12-07 20:18:11
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NIOS II是一个用户可配置的通用32位RISC嵌入式处理器。处理器以软核形式实现。NIOS的开发包括硬件和软件开发两部分。硬件是在Quartus II中实现的，而软件开发是在NIOS IDE中实现的。所谓硬件开发，就是用Quartus II和SOPC builder来建立自己需要的软核。
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2014-12-04 17:37:19
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工具：Quartus II
器件：EP4CE15F17C8
1.File->New Project Wizard：
2.点击两个Next，进入Family&Device Settings，选择器件
3.Finish，建立工程完毕，点击Tools->SOPC Builder，输入名字后，OK
4.修改clk_0为100MHz
5.component lib...
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2014-11-27 22:12:55
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altera fpga 用quartus综合后会出现加法进位链一正一反的情况，所谓一正一反指的是假设某一级输入为a，b，进位值为c，则该级进位链逻辑应该为cout=ab+ac+bc，但实际为cout=b'c'+a'c'+a'b'之后一级的进位链为cout=ab+ac'+bc'.那么假设前后两级都有进...
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2014-11-25 12:34:02
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选择File->Convert Programming Files...
Programming File Type选择JTAG Indirect ConfigurationFile(.jic)并选择要烧写的器件EPCS64
在Input files to convert选择Flash Loader，点击Add Device，添加FPGA类型
在Input files...
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2014-11-01 13:29:17
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在quartus的设置里有，物理综合综合优化，register retiming，是针对网表的优化。我们知道在组合逻辑之间插入寄存器可以优化设计的时序，而如果只是调整寄存器的位置来优化实现，这种技术被称为寄存器平衡。《高级设计》一书中提供了一个简单代码实例用以展示这种技术。这里我们需要注意的是本文介...
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2014-10-21 10:16:16
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我用的是quartus ii 13版本的仿真软件，在做VGA实验时显示用到640*480的图片所以就需要307200*1bit的rom。但是坑爹的megawizard- plug-in-manager最大可以生成的rom只有65536*1bit。如图一和图二所示。这里说一说怎么增加rom的大小，先按...
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2014-10-12 23:41:08
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