Chisel中的模块与Verilog HDL中模块的概念十分相似，都是用层次结构描述电路。Chisel中的module是一个类，其定义遵循以下几点：
继承自Module类， 有一个命名为io的端口， 在其构造函数中连接子电路
如下是一个2选1选择器的模块定义：...
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2015-08-18 16:31:59
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我们可以把一些重复的逻辑定义为函数，然后在多处使用，例如：如下定义了一个简单的函数：
def clb(a:UInt, b:UInt, c:UInt, d:UInt) = (a & b) | (~c & d)
函数clb有四个参数a、b、c、d，此处的def是Scala中定义的关键字，用来定义函数，每个参数后面跟一个冒号，然后是数据类型。在参数之后定义返回类型，也可以不定义，Chisel会自动推测，上例中就没有定义返回类型。等号之后的就是函数体。...
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2015-08-12 14:46:07
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Chisel是由伯克利大学发布的一种开源硬件构建语言，建立在Scala语言之上，是Scala特定领域语言的一个应用，具有高度参数化的生成器(highly parameterized generators)，可以支持高级硬件设计。其特点如下，部分特点找不到合适的中文表述，暂时没有翻译，哪位童靴有合适的翻译可以及时说说啊。...
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2015-08-10 14:54:37
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ARM是RISC结构，数据从内存到CPU之间的移动只能通过L/S指令来完成，也就是ldr/str指令。
比如想把数据从内存中某处读取到寄存器中，只能使用ldr
比如：
ldr r0, 0x12345678
就是把0x12345678这个地址中的值存放到r0中。
而mov不能干这个活，mov只能在寄存器之间移动数据，或者把立即数移动到寄存器中，这个和x86这种CISC架构的芯片区别最大的地...
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2015-07-29 17:21:21
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本文来自http://www.cnbeta.com/articles/224544.htmARM、ARM、ARM，没错ARM仿佛一夜之间就火了，平板、手机等领域随处可见它的影子，甚至已经有人预言未来有相当一部分原属于传统x86势力范围 的台式机份额也将被ARM占据。在这种情况下，大家不可避免地将AR...
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2015-07-26 14:06:18
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1、计算机的五大单元： 2、CPU分:精简指令集risc,复杂指令集cisc?x86架构。 容量单位：K、M、G、T、P 速度单位：CPU运算单位MHz,GHz,Hz 其实就是秒分之一。而在网络传输方面，由於网络使用的是 bit 为单位，因此...
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2015-07-16 17:07:29
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RISC(精简指令集计算机)和CISC(复杂指令集计算机)是当前CPU的两种架构。它们的区别在于不同的CPU设计理念和方法。早期的CPU全部是CISC架构，它的设计目的是要用最少的机器语言指令来完成所需的计算任务。比如对于乘法运算，在CISC架构的CPU上，您可能需要 这样一条指令：MUL ADDR...
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2015-07-07 10:59:20
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最近大概阅读了一个UCB发布的Rocket处理器的源码，对源代码各个文件的功能有了一些大致的了解，Mark一下。
Rocket是一款64bit的标量处理器，5级流水线，采用的是risc-v指令集，集成FPU，并有许多or1200没有的特性，比如：无阻塞缓存、分支预测、返回地址堆栈、硬件页表填充、cache支持ECC、支持多核等。
Rocket的源代码是使用Chisel编写的，Chisel是UCB发布的基于Scala的领域特定语言。可以在https://github.com/ucb-bar/rocket下...
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2015-06-23 15:42:53
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查看数据库监听状态不对$ lsnrctl statusLSNRCTL for IBM/AIX RISC System/6000: Version 10.2.0.5.0 - Production on 05-NOV-2012 08:54:08Copyright (c) 1991, 2010, Orac...
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2015-06-11 22:45:49
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在《Chisel实验笔记（二）》中，通过编写TestBench文件，然后使用Icarus Verilog、GtkWave可以测试，查看相关波形，比较直观，在《Chisel实验笔记（三）》直接对得到C++模拟器进行测试，也可以得到测试结果，实际上对C++模拟器进行测试也可以同时得到vcd文件，从而使用GtkWave查看波形，得到直观的结果。本文就介绍了这个过程。...
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2015-06-04 09:47:21
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