在用Vivado （2015.4.2）在ZedBoard上搭建如图所示的PS最小系统时，USB-OTG无法正常使用且在启动LOG中报错。 经过与原厂的各个启动文件进行对比替换，最后确定是Vivado工程生成的bit流出了问题。也就是说建立的工程不对。 USB 启动错误提示信息：外置PHY芯片初始化失 ...
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2017-04-04 17:38:01
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最近在做这个方面的项目，先写一个总结吧 需要准备的材料： 1. vivado 工程生成的 system_wrapper.bit。 2. 在SDK里面建立Zynq FSBL 中的 FSBL.elf。 3. 编译linux uboot生成uboot文件(改名成uboot.elf文件)。 这三个文件（顺序 ...
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2017-03-28 21:53:13
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1、参考(原创)基于ZedBoard的Webcam设计(三)：视频的采集和动态显示http://www.cnblogs.com/surpassal/archive/2013/01/12/zed_webcam_lab3.html 下载代码实测可用。 ...
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2017-03-04 15:25:10
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接上一篇，下面安装opencv。 一般都是参照陆佳华那本白色封皮的《软硬件协同设计》，但是不得不说这本书实在太粗糙了，很多的细节都没有说明。 首先，在PC和这块板子的方法是一样的，所以PC机上没有安装的也可以按照这个方法 一般的方法是交叉编译的方法，因为快。但是我等懒人就不想这么麻烦，所以呢，就按照 ...
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2016-11-26 03:03:31
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最近一直在搞板子，想帮Zedboard安装一个opencv谁知道困难重重，而且网络几乎没有任何资料可以参考，只有陆佳华的《嵌入式软硬件协同设计实战指南》可以参考。 但是这本书讲得不清不楚，出现非常多的问题。下面把我的经验和大家分享一下 1.构建Linux系统 采用的系统与书上的并不一致，这本书的镜像 ...
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2016-11-26 02:37:36
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一步一步学ZedBoard & Zynq(七)：制作ZedBoard上linux根文件系统(ramdisk)
网址：http://xilinx.eetrend.com/blog/3935
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2016-11-19 16:29:43
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上一节说到了DDR寻址的问题，如下图： 从官方文档上我们看到了DDR的地址是从0008_0000开始的，那么我们开始修改Xilinx给我们提供的IP核代码。其实很简单，上一节已经分析了地址停留在0000_1000的原因，现在我们只需要把write_burst_counter的位宽变大就可以了。 从上 ...
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2016-07-20 22:44:25
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有了前面的一堆铺垫。现在终于开始正式准备读写DDR了，开发环境：VIVADO2014.2 + SDK。 一、首先要想在PL端通过AXI去控制DDR，我们必须要有一个AXI master，由于是测试，就不自己写了，直接用package IP生成，方法如下： 1.选择package IP工具 2.创建新 ...
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2016-07-20 19:32:46
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虽然Xilinx已经将和AXI时序有关的细节都封装起来，给出了官方IP和向导生成自定义IP，用户只需要关注自己的逻辑实现，但是还是有必要简单了解一下AXI的时序，毕竟咱是做硬件设计的。 AXI（Advanced eXtensible Interface）是一种总线协议，该协议是ARM公司提出的AMB ...
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2016-07-16 22:38:27
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看了一段时间的DDR手册，感觉大体有一点了解了，想要实际上板调试，然而实验室可用的开发板不多，拿了一块zynq板看了看，DDR确实有，但是已经集成了控制器，而且控制器还放到了PS端，PL只能通过AXI接口访问。 无奈另外两块开发板也这样，索性就用AXI去控制吧，正好还能再复习一遍AXI。 先简单介绍 ...
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2016-07-15 13:07:04
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