环境配置： 安路FPGA的环境比较好搭建 直接去sipeed下载站中即可下载 如果出现没有license的情况 参加这篇帖子 新建工程： 这是安路TD开发软件的界面 新建项目点击左上角菜单的 “project” 再点击 "New Project" 选择好芯片后，就可点击“OK”建立工程了 接下来右键 ...
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2021-06-13 10:13:07
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环境配置好后就正式进入verilog的学习了 先从最简单的点灯开始 我会向你们介绍最基础的数据类型和语法规则 仍然是从我们熟悉的界面开始 转到顶层模块 start中 首先，verilog都是以模块为单位进行编程 模块以 “module” “endmodule” 作为界限 如图既是定义一个模块star ...
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2021-06-13 10:12:36
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在实际FPGA开发过程中 我们不可能直接将代码烧录进板子里进行测试 一是我们无法观察到其内部逻辑变换 而是万一代码中的逻辑有问题 直接进行甚至会导致芯片损坏 毕竟FPGA无法像单片机那样可以利用串口打印等调试方法 FPGA调试只能靠仿真 依然是拿之前我们写的点灯代码做测试 首先，仿真需要安装mode ...
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2021-06-13 10:12:09
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数字电路可分为2大类： 组合电路和时序电路 组合电路的输出只取决于它的输入 并能够在一瞬间完成，与之前状态无关 时序电路则是在时钟控制下有条理的运行 受时钟信号和输入的控制，与之前状态有关 之前的点灯程序就是时序电路 现在我们先从组合电路开始学习 写一个简单的3-8译码器 我们已经了解数字电路的基本 ...
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2021-06-13 10:11:19
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背景 在做moblink自动化测试任务时，遇到以下问题，导致测试用例编写遇到问题。需要在mobLink APP中分享一条链接，并且使用多种浏览器打开链接唤醒mobLinkAPP。 appium提供了一个方法可以在浏览器中打开URL driver.get(String URL); 此方法执行时，app ...
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2021-06-11 18:13:04
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第一个Mybatis程序 思路：搭建环境—>导入Mybatis—>编写代码—>测试！ 2.1、搭建环境 2.1.1、搭建数据库 CREATE TABLE `Users`( `id` INT(10) NOT NULL, `name` VARCHAR(30) NOT NULL, `pwd` VARCHA ...
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2021-06-10 18:40:34
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只是简单测试使用的话，在系统上操作就行，tina默认使用 procd-init 并在其中集成了喂狗功能，所以要先关了自带的喂狗功能。 先让procd停止喂狗： ubus call system watchdog '{"magicclose": true}' ubus call system watc ...
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系统相关 时间：
2021-06-10 18:29:23
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产品特点 ? 复旦微JFM7K325T和JFM7V690T，兼容Xilinx的K7和V7 ? 两片FPGA都可通过MCU子板软配，其中K7可以通过Flash配置 ? 采用PCIe卡形式，通过金手指与主板连接 ? 设计有PCIe ×8、万兆SFP以及千兆以太网等高速接口，配合V7大容量FPGA，可实现 ...
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2021-06-07 20:49:51
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for link in driver.find_elements_by_css_selector("tr:nth-child(1) > td.taskStatus use"): assert_status = link.get_attribute('xlink:href') print(assert ...
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编程语言 时间：
2021-06-07 20:49:35
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rows = driver.find_elements_by_css_selector('div.wrapper>ul.list>li')logger.info(len(rows)) ...
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2021-06-07 20:41:35
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