我们知道 s5pv210启动方式有很多种，sd卡和nand flash 启动就是其中的两种，前面我们实现的都是基于sd卡启动，这节我们开始实现从nand flash 启动：
从 NAND 启动 u-boot，需要 BL1 初始化 NAND 控制器，然后从 NAND 拷贝 BL2 到 DDR 内存。这里的BL1 即我们移植的 u-boot-spl.bin，BL2 即我们移植的 u-bo...
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2014-07-23 17:00:11
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DDR采用一个周期来回传递一次数据，因此传输在同时间加倍，因此就像工作在两倍的工作频率一样。为了直观，以等效的方式命名，因此命名为DDR 200 266 333 400。DDR2尽管工作频率没有变化，数据传输位宽由DDR的2bit变为4bit，那么同时间传递数据是DDR的两倍，因此也用等效频率命名，...
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2014-07-22 22:35:15
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“炫舞家“ST时间限制：3000ms | 内存限制：65535KB难度：3描述ST是一个酷爱炫舞的玩家。TA很喜欢玩QQ炫舞，因此TA也爱屋及乌的喜欢玩跳舞机（Dance Dance Revolution，DDR）。但是TA每天还要努力的学习，因此TA希望每次都保存最多的体力来学习。DDR的主要内容...
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2014-07-18 13:26:50
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STB启动流程 1. uboot启动（Fastboot启动） 硬件资源检测（如CPU，DDR Size，Nand flash，mem size,flash size） print Version(如HW Version,Boot Version,Loader Version) b...
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2014-07-01 21:59:05
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本文更多的是教会大家如何学习。
4.1 汇编学习
4.1.1 基础知识
4.1.2 ARM模拟器
4.2 S5PV210启动流程
4.3 点亮一个LED
4.4 串口
4.5 实现printf函数
4.6 时钟配置
4.7 重定位（BL1加载BL2到SRAM）
4.8 DDR
4.9 NAND FLAS...
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2014-07-01 06:48:04
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优化可以从以下几个方向入手：指令预测，数据预取，缓存命中，ddr访问延迟，指令优化，硬件内存管理优化，数据对齐。...
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2014-06-22 11:12:56
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最近在实际的项目中碰到这样的问题:
嵌入式系统DDR (RBC row, bank, columne), 每块1Gbit816, 两块由片选决定读写其中的一块.
Memory controller通过AXI连接在SOC中.
1.
在I-CACHE没有使能的情况下, 通过MC访问DDR有三路TRAFFIC, 分别是取指令, CPU刷/写FRAME BUFFER, DMA取/读FRAM...
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2014-06-08 08:58:15
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“炫舞家“ST时间限制：3000 ms | 内存限制：65535
KB难度：3描述ST是一个酷爱炫舞的玩家。TA很喜欢玩QQ炫舞，因此TA也爱屋及乌的喜欢玩跳舞机（Dance Dance
Revolution，DDR）。但是TA每天还要努力的学习，因此TA希望每次都保存最多的体力来学习。DDR的主要...
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2014-05-14 09:27:10
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1.防呆缺口DDR内存单面金手指针脚数量为92个（双面184个），缺口左边为52个针脚，制品右边为40个针脚；DDR2内存单面金手指120个（双面240个），缺口左边为64个针脚，缺口右边为56个针脚；DDR3内存单面金手指也是120个（双面240个），缺口左边为72个针脚，缺口右边为48个针脚.2...
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2014-04-30 04:57:39
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