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1.寄存器输出型状态机 VS 组合逻辑输出型状态机
2.状态编码方法
这块讲的不好，也比较少。
3.系统设计中模块划分的指导性原则
paper:基于verilog HDL 的高速可综合FSM设计
原文地址：http://www.cnblogs.com/chip/p/5467623.html
