标签：span 信息 时钟频率 路径 时序 font 代码 目的 完成
在IP设计过程中RTL代码完成后会对设计完成的代码进行逻辑综合(主要对时钟约束，其他约束不加)，
目的是对代码中的关键路径，时钟频率和面积信息做一个初步的判断（和最后实际的时钟频率和面积会有
一些差异）
逻辑综合DC报告——时序和面积信息查看学习
原文地址：https://www.cnblogs.com/hesn/p/11478372.html
