时钟分频

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偶数分频：通过计数器实现，进行N倍偶数分频，通过时钟触发计数器计数，当计数器从0计数到N/2-1时，输出时钟进行翻转，以此循环下去。（占空比为50%）
用于FPGA开发板进行简单的时钟分频，以下代码实现二分频和四分频，可根据实际需求改变参数输出需要的时钟。
`module clk(clk,sys_rst_n,vga_clk,clk_2);
input clk;
input sys_rst_n;
output reg vga_clk;
output reg clk_2;

 parameter NUM_DIV = 4;//四分频
 parameter NUM_DIV_2 = 2;//二分频
 reg    [3:0] cnt;
 reg    [3:0] cnt1;

always @(posedge clk or negedge sys_rst_n)
if(!sys_rst_n) begin
cnt <= 4‘d0;
vga_clk <= 1‘b0;
end
else if(cnt < NUM_DIV / 2 - 1) begin
cnt <= cnt + 1‘b1;
vga_clk <= vga_clk;
end
else begin
cnt <= 4‘d0;
vga_clk <= ~vga_clk;
end

always @(posedge clk or negedge sys_rst_n)
if(!sys_rst_n) begin
cnt1 <= 4‘d0;
clk_2 <= 1‘b0;
end
else if(cnt < NUM_DIV_2 / 2 - 1) begin
cnt1 <= cnt1 + 1‘b1;
clk_2 <= clk_2;
end
else begin
cnt1 <= 4‘d0;
clk_2 <= ~clk_2;
end

endmodule`
本篇随笔为学习记录所用，如有侵权请联系作者。

时钟分频

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