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AE2ACE coursework
AE2ACE coursework 2019-2020This coursework is worth 25% of the final mark.Stock Trading & Algorithm Correctness.Deadline: 29 November 2019 16:00Part I ...
分类:其他好文   时间:2019-12-14 21:06:33    阅读次数:88
【springboot】给你一份Spring Boot知识清单
原文作者:CHEN川 原文地址:http://www.jianshu.com/p/83693d3d0a65 预警:本文非常长,建议先mark后看,也许是最后一次写这么长的文章 说明:前面有4个小节关于Spring的基础知识,分别是:IOC容器、JavaConfig、事件监听、SpringFactor ...
分类:编程语言   时间:2019-12-14 18:59:13    阅读次数:127
sql 练习题(1)
-- 1、查询"01"课程比"02"课程成绩高的学生的信息及课程分数 -- mark一下,"一个表当两个表用" SELECT a.* ,b.s_score AS 01_score,c.s_score AS 02_score FROM student a JOIN score b ON a.s_id= ...
分类:数据库   时间:2019-12-12 22:25:06    阅读次数:203
ECON215 Coursework
ECON215 CourseworkThe ECON215 Coursework Exercise is 100% of the module mark. The deadline for submitting the assignment (online only, see below) is 5 ...
分类:其他好文   时间:2019-12-11 13:05:01    阅读次数:79
【C++】regex_search 匹配字符串出错
regex_search 在处理特殊中文的时候会出错。 直接上代码: 运行结果如下: 很奇怪微软是怎么实现的,先mark下,等有时间了再去看源码。 ...
分类:编程语言   时间:2019-12-10 19:46:04    阅读次数:169
mark_Linux_wc
Linux wc命令 Linux wc命令用于计算字数。 利用wc指令我们可以计算文件的Byte数、字数、或是列数,若不指定文件名称、或是所给予的文件名为"-",则wc指令会从标准输入设备读取数据。 语法 参数: -c或--bytes或--chars 只显示Bytes数。 -l或--lines 只显 ...
分类:系统相关   时间:2019-12-09 14:22:47    阅读次数:91
BFS
1,为什么bfs要用到队列。 2,对于你可以遍历到的所有状态,先把他们加到一个队列中,然后再去遍历他们。 3,简单说就是先mark,然后在遍历。 4,代码框架 void bfs() { push(..)//把起始状态入队列 while(!empty()){//当队列不为空时候 x=pop(); fo ...
分类:其他好文   时间:2019-12-08 15:27:27    阅读次数:79
什么是<!DOCTYPE html>,以及其重要性
什么是<!DOCTYPE html>? 在HTML文档初,往往会有这么一句话<!DOCTYPE html>,那么它的意义是什么呢?它是html5标准网页声明,全称为Document Type HyperText Mark-up Language,意思为文档种类为超文本标记性语言或超文本链接标示语言, ...
分类:Web程序   时间:2019-12-08 12:37:24    阅读次数:133
【Mark】包装类 19_12_7
包装类 包装类型非常有用 包装类型就是把基本类型包装为class public class Integer { private int value; public Integer(int value) { this.value = value; } public int intValue() { r ...
分类:其他好文   时间:2019-12-07 21:19:08    阅读次数:89
Xilinx FGPA 上板调试 集成逻辑分析工具 Integrated Logic Analyzer(ILA) 简单配置
Xilinx Vivado 提供了上板后的FPGA逻辑分析,信号视图显示等功能。 需要注意,上板后查看信号需要重新综合,并且需要耗费一定的片上布局布线资源。 1. 添加debug信号 可以对模块端口或者wire 变量进行debug信号提取,只要在verilog代码前面添加:(* MARK_DEBUG ...
分类:其他好文   时间:2019-12-06 21:17:01    阅读次数:124
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