ARM异常中断处理：
ARM体系异常中断种类：按中断的处理优先级从高到低依次为：复位、数据访问中止、快速中断请求、外部中断请求、预取指中止、未定义指令、软件中断。
ARM体系中的异常中断向量表：
0x0 复位
0x4 未定义指令
0x8 软件中断(SWI)
0x0c 预取指中止
0x10 数据访问中止
0x14 保留
0x18 外部中断请求(IRQ)
0x1c 快速中断请求(F...
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2014-06-15 15:07:19
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在多指令流多数据流MIMD里面有用到基于超立方体互联的网络，
用《图论导引》里面简单的描述，就是处理器能通信，当且仅当他们的邻接（k元祖代表了处理器的地址）
一个 k 维立方体（或者超立方体Qk）是一种简单图，每个顶点{0,1}标记的k元祖来表示。
相邻的顶点之间的 k 元祖只有一个位置上数字不同，Qk 的生成立方体 Qj 和 Qj 本身同构。
这是Q3的表示：...
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2014-06-15 14:42:41
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{{ message}} var app = angular.module('firstapp', []);创建了一个module实例，第一个参数为 module名字，第二个参数为依赖数组。app.factory('message', function(){ r...
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2014-06-15 14:23:00
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引脚部分查看中文的12864介绍，下面这些可以在ST7920的英文数据手册里查到。Function Description 部分介绍工作方式、存储器、操作方法。Instructions 部分介绍指令。按照并行或串行的 Timing Diagram 来操作，注意数据何时有效。查看初始化的流程图，按照F...
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2014-06-15 13:13:45
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（1）定义：
多处理机属于多指令流多数据流系统。它由多个独立的处理机组成，每个处理机都能独立执行自己的程序。
（2）对比：
让我们对并行处理机和多处理机做一个对比。对于并行处理机并行性存在于指令内部，实现操作级的并行（单指令流多数据流）。而多处理机的并行性存在于指令外部，表现于多个任务间的并行。
（3）硬件结构分类：
多处理机在硬件结构上分为紧耦合多处理机和松耦合多处理机...
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2014-06-15 11:03:53
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在多指令流多数据流MIMD里面有用到基于超立方体互联的网络结构，用《图论导引》里面简单的描述，就是处理器能通信，当且仅当他们的邻接（k元祖代表了处理器的地址）一个 k 维立方体（或者超立方体Qk）是一种简单图，每个顶点{0,1}标记的k元祖来表示。相邻的顶点之间的 k 元祖只有一个位置上数字不同.....
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2014-06-15 10:36:10
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题目：学生管理系统
1. 语言和环境
A、实现语言：
C
B、实现技术：
C语言
C、环境要求：
VC++6.0
2. 要求
实现一个学生管理系统。
功能和界面设计要求：
1、 运行后显示主界面
2、 根据操作指令进行相应的操作，具体要求如下:。
3. 推荐实现步骤
. 设计程序
制作主界面：
A、设计登录窗体，界面如下图1所示。（10分）
...
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2014-06-14 17:27:39
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当某线程触发GC时,任何线程不能再访问任何的对象.在GC执行时,可能会修改对象的地址.GC执行时,大多使用劫持法,将所有的线程挂起.对于含有Loop,且Loop内不再调用其它方法时.会生成一个编译时表.当线程的指针指令执行到该处时,会认为到达了一个安全点,线程可以被挂起.对于其它方法,GC会劫持线程...
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2014-06-14 15:57:14
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阵列处理机：
通过重复设置大量相同的处理单元PE（Processing Element），将它们按一定方式互连成阵列，在单一控制部件CU（Control Unit）控制下，对各自所分配的不同数据并行执行同一组指令规定的操作。是操作级并行的SIMD计算机（SIMD指的是单指令流多数据流，是一种实现数据级并行的技术）。
阵列处理机的构形：
分布式存储器的阵列处理机构形集中式共...
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2014-06-14 15:05:57
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CISC的特点：
指令系统庞大，指令功能复杂，指令寻址方式多，指令格式多绝大多数指令需要多个机器周期完成各种指令都可以访问存储器采用微程序控制有专用寄存器，少量难以用优化编译技术生成高效的目标代码程序
RISC特点：
大多数指令在单周期内完成LOAD/STORE结构硬布线控制逻辑减少指令和寻址方式的种类固定的指令格式注重编译的优化（三地址指令格式、较多的寄存器、对...
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2014-06-14 12:22:43
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