一、板卡概述 本板卡基于Xilinx公司的FPGA XC7Z045 FFG 9000 芯片， DDR3容量2GByte，HPC的FMC连接器，板卡支持各种接口输入，软件支持windows，Linux驱动。 二、功能和技术指标： ?支持64bitDDR3， 容量2GByte； ?支持1个FMC HPC ...
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2017-04-26 15:56:07
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本博文採用Xilinx HLS 2014.4工具。实现一个肤色检測的模块。当中，本文重点是构建HLS图像处理函数。新建HLSproject的步骤，本博文不再详述。 本project新建之后，仅仅加入了五个文件，例如以下图所看到的。当中，top.cpp中的主函数终于会综合生成HLS硬件图像处理模块。t ...
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2017-04-25 19:17:44
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使用Synplify Pro加时序约束。综合完毕后，可以在ISE中进行布局、布线。需要用.ucf文件指定布局布线的时钟约束。前者可以比后者小。 早期的ISE，两个约束可以继承。现在用的高版本，反而需要分别指定，否则会忽略掉。 将综合（Synthesis）的频率提高，将布局布线（Place & rou ...
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2017-04-23 11:21:32
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This problem could occur when support and/or tclapp directories are missing in your $HOME/.Xilinx/Vivado/2014.3/XilinxTclStore directory. To work arou ...
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2017-04-21 20:14:32
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多工艺产品系列 产品表和产品选择指南 Spartan-6 开发软件 ISE 从 2013 年 10 月起不再更新ISE系列开发软件，开发软件替换为Vivado系列的开发软件。 Vivado Design Suite Vivado设计套件是赛灵思面向未来十年的 "All-Programmable"器件... ...
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2017-04-21 17:58:16
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Vivado安装破解流程 安装 Xilinx Vivado Design Suite 安装文件，解压后得到安装目录： 运行 xsetup.exe 文件，进入安装程序。如果提示要更新就直接点 continue 关掉。 然后点击next。 对使用许可声明等选择 I Agree。 选择vivado sys... ...
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2017-04-21 16:31:23
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在Vivado中，EMIO IP(system和AXI扩展部分)引出实际上有3个管脚，分别是gpio_i,gpio_o,gpio_t， 要把它们转化为标准的GPIO，要外加缓冲器，步骤如下 在顶层模块中，会生成如下代码 IOBUF gpio_0_tri_iobuf_0 (.I(gpio_0_tri_ ...
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2017-04-11 14:40:46
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一：前言 这篇博客是我应一位网友之约写的，他想要学习基于FPGA的PCIe DMA控制器设计，但是手上没有合适的Xilinx开发板，而且xapp1052又没有提供仿真代码，让他的学习陷入了困境。所以我想了想，还是用EDK搭建一个微小系统，然后用modelsim来仿真xapp1052的DMA收发控制， ...
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移动开发 时间：
2017-04-09 14:56:19
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上一次讲到USB不启动问题是由与Vivado工程中的EMIO引脚未正确配置造成的，那么软件上又是如何使用这个引脚的呢？ 首先，Xilinx提供的Linux 开发包中已经包含了gpio的驱动和sysfs进行配套，并在设备树文件中对OTG-RESETN进行了初始化配置和声明。 其次，在实际使用中，USB ...
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2017-04-04 18:50:38
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在用Vivado （2015.4.2）在ZedBoard上搭建如图所示的PS最小系统时，USB-OTG无法正常使用且在启动LOG中报错。 经过与原厂的各个启动文件进行对比替换，最后确定是Vivado工程生成的bit流出了问题。也就是说建立的工程不对。 USB 启动错误提示信息：外置PHY芯片初始化失 ...
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数据库 时间：
2017-04-04 17:38:01
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1192
