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搜索关键字:CPU Heap Stack    ( 35112个结果
黑马程序员——Java多线程
多线程基础知识进程是一个正在执行的程序。cpu在同时执行这些程序,其实是跳跃式的,做快速的切换,时间很短。一个进程可能存在多条路径。迅雷的多路径。每一个进行执行都有一个执行顺序,该顺序是一个执行路径,或这叫一个控制单元。每一个进程至少有一个线程,线程就是进程中的一个独立的控制单元,线程控制进程的执行...
分类:编程语言   时间:2014-05-15 10:38:01    阅读次数:406
学习 iOS多线程开发 Demo示意
并发所描述的概念就是同时运行多个任务。这些任务可能是以在单核 CPU 上分时(时间分享)的形式同时运行,也可能是在多核 CPU 上以真正的并行方式来运行。这篇文章是作者在学习iOS开发技术当中,遇到多线程问题时捋顺思路时的一些看法。 GCD是iOS开发当中解决多核开发的一个技术。 主要有三种...
分类:移动开发   时间:2014-05-15 02:19:14    阅读次数:393
《深入Java虚拟机学习笔记》- 第9章 垃圾收集
一、Java内存组成组成图堆(Heap)运行时数据区域,所有类实例和数组的内存均从此处分配。Java虚拟机启动时创建。对象的堆内存由称为垃圾回收器的自动内存管理系统回收。组成 组成 详解Young Generation即图中的Eden + From Space + To Space1.Eden存放新...
分类:编程语言   时间:2014-05-15 02:07:43    阅读次数:320
让你提前认识软件开发(21):C程序中的定时器
第1部分 重新认识C语言C程序中的定时器 【文章摘要】        在实际的C程序中,一个模块执行多个操作是很常见的事情。如果多个操作同时进行,会出现程序效率低下、计算机CPU占用率过高等情况,这时就需要对所有操作的执行顺序作一个合理的安排,这就涉及到定时器的使用。        本文对C程序中的定时器的类型、设置和清除方法等作了详细的介绍,为相关开发工作的开展提供了参考。【关键词】      ...
分类:其他好文   时间:2014-05-15 01:27:31    阅读次数:336
TI C66x DSP 系统events及其应用 - 5.3(Interrupt)
对于TI C66x DSP的每个CPU有INT4~15共12个中断输入。对于中断,event combiner将event 4~127分为4个组(event 0~3为INTC内部使用,如图示为event combiner的四个输出)。类似于4.x中的exception,中断也有同样功能的event flag,event mask,masked event flag寄存器。...
分类:其他好文   时间:2014-05-14 23:54:21    阅读次数:645
关于C#数据类型自己的理解
电脑CUP处理程序的运行。cpu里分为一级缓存,二级缓存,还有三级缓存,之后是内存里的东西。 栈存放在一级缓存里,所以cup调用速度最快,处理起来也效率也最高,但是大小很小,能存放的东西很少。 堆存放在二级缓存里,离cpu不一级缓存远一点,但是存储的数据量更大一些。 C#里值类型创建的...
分类:其他好文   时间:2014-05-14 22:51:38    阅读次数:405
java 多线程sleep和wait的区别
对于sleep()方法,我们首先要知道该方法是属于Thread类中的。而wait()方法,则是属于Object类中的。sleep()方法导致了程序暂停执行指定的时间,让出cpu该其他线程,但是他的监控状态依然保持者,当指定的时间到了又会自动恢复运行状态。在调用sleep()方法的过程中,线程不会释放...
分类:编程语言   时间:2014-05-14 22:28:53    阅读次数:375
Linux环境编程之进程(二):程序的存储空间布局
引言: 一个写好的程序一般要存放在存储器中,那么程序中的代码、数据等各部分,是如何有规律的存放在存储器中的呢? (一) 一个存储的程序可分为五部分:正文段、初始化数据段、非初始化数据段、栈、堆。其典型的存储安排如下图: 正文段:这是由CPU执行的机器指令的部分。通常,正文段是可共享的,所以即使是频繁执行的程序在存储器中也只需要一个副本,另外正文段常常是只读的,以防止程序由于意外而修...
分类:系统相关   时间:2014-05-14 21:42:57    阅读次数:604
TI C66x DSP 四种内存保护问题 -之- 针对CPU访问外存(DDR3 or MSM)时的内存保护问题
DSP访问外存时内存保护的问题,原因是CPU访问了自己没有访问权限的外部内存(如share memory即MSM或者DDR3,相对于corePac内部的L1,L2内存而言),如CPU访问DDR3中的无权限内存时(即在当前CPU的配置中,没有设置对该内存的访问权限),硬件会触发MDMA bus error event(VbusM error event 110,CPU访问corePac内部资源L1,...
分类:其他好文   时间:2014-05-14 21:23:30    阅读次数:300
Node.js异步处理CPU密集型任务
这篇文章提出了backgroundjs这个新的概念,扩展了Node.js的能力,解决了Node在处理CPU密集任务时的短板。这个解决方案使得使用Node的开发人员只需要关注backgroundjs中的函数。比起多开进程或者新添加模块的解决方案更高效,通用和一致。...
分类:Web程序   时间:2014-05-14 21:16:18    阅读次数:502
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