可编程中断控制器Programmable Interrupt Controller（PIC）用来响应各种中断事件，如：键盘事件、串口数据到达等，PIC收集所有的中断，并通知CPU中断到达，后者转入到中断处理例程进行处理。OR1200最多支持32个中断。其功能实现主要依靠两个特殊寄存器：中断屏蔽寄存器PICMR、中断状态寄存器PICSR。通过PICMR可以设置是否屏蔽某些中断，通过PICSR可以知道中断源的信息。...
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2014-07-04 08:13:56
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计时器模块（Tick Timer：TT）一般用在操作系统的进程调度、用户程序的定时参考等。TT内部会对时钟周期计数，当计数值达到一个预设值时，会产生中断，通知处理器进行处理。其实现的主体是两个特殊寄存器：计时器单元计数寄存器TTCR、计时器单元模式寄存器TTMR，通过这两个SPR的不同配置，实现不同的工作模式，以及计时中断的产生。TTCR、TTMR是第10组特殊寄存器...
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2014-07-02 16:34:11
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WB_BIU模块是OR1200处理器与外部Wishbone总线连接的接口模块，15.1节给出了WB_BIU模块的对外连接关系，并指出WB_BIU模块的三个作用。因为OR1200处理器支持Wishbone B3版本，所以在15.2节介绍了Wishbone B3版本中的寄存反馈总线周期，重点说明了其中的周期类型识别地址标签CTI_O/CTI_I、突发类型扩展地址标签BTE_O/BTE_I的作用。...
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2014-07-01 15:31:19
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SB的作用是通过缓冲存储操作，从而加快存储操作。其原理是这样的：当执行存储操作时，可能需要通过WB_BIU将要写的数据写入外部Memory，尤其是在通写法模式下，每次执行存储操作都要将数据写入外部Memory，这样会等待外部Memory完成存储操作，在此期间，CPU处于暂停状态，降低了CPU的效率，引入SB后，如果是存储操作，那么SB模块将本次操作保存起来，同时立即向DCache返回一个存储完成信号（dcsb_ack_o为1），使得CPU可以继续执行，然后SB模块会接着完成被其保存起来的存储操作。在SB内部...
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2014-06-28 07:46:47
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存储指令执行阶段DCache失靶这种情景在通写法、回写法策略下有不同的执行过程，在通写法策略下直接写存储器中对应的地址，不操作DCache。在回写法策略下，首先判断目的地址对应的DCache中目录表的line是否被修改，如果是（Dirty为1），则将该line写回到内存，然后将目的地址所在的内存块读入DCache，填充到对应line，然后再修改DCache中对应目的地址的数据；如果目的地址对应的line没有被修改（Dirty为0），那么直接将目的地址所在的内存块读入DCache，填充到对应line，然后再修...
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2014-06-26 08:05:36
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DCache中缓存的是数据，而ICache中缓存的是指令，这就是DCache与ICache的根本区别，由此也决定了DCache的特别之处。指令存储在指令存储器中，且指令存储器是只读的，对应只有一个取指操作，但是数据存储在数据存储器中，且数据存储器是可读、可写的，对应加载、存储两个操作。一般情况下，指令存储器、数据存储器都属于内存的一部分，有时就是内存中同样的地址空间。
当向数据存储器中存储数据且DCache命中时，称之为写命中，可以采用两种策略：...
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2014-06-22 20:20:42
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通过对使用DCache各种情景的分析以实现对DCache模块的剖析，使用到DCache的情景有如下几种：
（1）l.mtspr指令写DCache中的特殊寄存器（分通写法、回写法）
（2）存储指令执行阶段DCache失靶（分通写法、回写法）
（3）加载指令执行阶段DCache失靶（分通写法、回写法）
（4）存储指令执行阶段DCache命中（分通写法、回写法）
（5）加载指令执行阶段DCache命中（DCache的工作过程在通写法、回写法下是...
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2014-06-22 17:02:20
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以下内容摘自《步步惊芯——软核处理器内部设计分析》一书
12.1 Cache基本知识
12.1.1 Cache的作用
处理器的设计者一般会声称其设计的处理器一秒钟能做多少次乘法、每条指令只占用xx个时钟周期，可是当我们实际使用处理器时，就会发现并不是那么回事，比如在第11章，从图11.8中可以发现，当程序运行在简单SOPC上时，原先设计在执行阶段只需要一个时钟周期的指令l....
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2014-06-19 11:51:49
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同第10章分析MMU的方法一样，本章也是采用情景分析法，通过对使用ICache的各种情景的分析以实现对ICache模块剖析。使用ICache的情景有如下几种：
（1）l.mtspr指令写ICBIR
（2）指令取指阶段ICache失靶
（3）指令取指阶段ICache命中
（4）指令取指阶段，目的指令所在的内存页禁止缓存
上述四种情景中，情景（1）在流水线的执行阶段使用到了ICache，情景（2）、（3）、（4）在流水线的取指阶段使用到了ICache。...
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2014-06-18 11:25:08
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OR1200中实现ICache的文件有or1200_ic_top.v、or1200_ic_fsm.v、or1200_ic_tag.v、or1200_ic_ram.v、or1200_spram.v，分别实现了ICache模块、IC_FSM模块、IC_TAG模块、IC_RAM模块、单口RAM。在ICache中例化了IC_FSM、IC_TAG、IC_RAM模块，在IC_TAG、IC_RAM模块中例化了单口RAM。如图12.4所示。其中IC_TAG、IC_RAM可以称为数据部分，IC_FSM可以称为控制部分，在数据...
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2014-06-14 06:24:13
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