用syonpsys工具试着研究了一下，也把自己的感悟分享出来，欢迎指正； 综合用的dc，后仿真用的vcs； 对于非展平的网表： 1. 子模块内部的触发器类型，比如时序逻辑reg[7:0] temp;非展平之后，必然存在与之对应的wire[7:0] temp数据类型，并且命名完全相同，连接std ce ...
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2018-12-25 21:09:24
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MPTCP采用的是双层序列号（更多详细介绍可阅：https://www.cnblogs.com/DesperateCupid/p/7898795.html） 从图中可知道这两层序号的名字是data sequence number和subflow sequence number，所以对应的，在wire ...
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2018-12-04 20:36:19
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https://mp.weixin.qq.com/s/bSrM-wLRn7O_75xYKeoaEQ Chisel中的基本数据类型，不是Verilog中的Wire和Reg。Wire和Register只是数据的容器，而非数据本身。所以Chisel中的数据类型抽象层次更高一些，更关注数据的行为和组织形式的 ...
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2018-11-30 00:38:31
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1 关于参数定义 Parameter：parameter只能定义在端口生命的前面，如 Input[whith:0] a; Parameter whith=4; 这样的参数定义出现在声明的后面会报错 2 关于always块 always块不仅可以描述时序逻辑，也可以描述组合逻辑 如wire a,b; ...
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2018-11-20 21:45:18
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P2885 [USACO07NOV]电话线Telephone Wire 最近，Farmer John的奶牛们越来越不满于牛棚里一塌糊涂的电话服务于是，她们要求FJ把那些老旧的电话线换成性能更好的新电话线。 新的电话线架设在已有的N(2 include include include include ...
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2018-11-07 13:12:58
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PoPo数据可视化 聚焦于Web数据可视化与可视化交互领域，发现可视化领域有意思的内容。不想错过可视化领域的精彩内容, 就快快关注我们吧 :) World Wire 数据可视化演示（视频） IBM公司于2018年8月推出全球支付系统“World Wire” 珊瑚城市-全球10大最适宜居住的城市（视频 ...
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2018-11-01 20:27:56
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https://mp.weixin.qq.com/s/tEDMWf1gk0e7u4hIWKM9bQ ?? 一. 拓扑 数字电路的拓扑抽象出来之后比较简单，就是线（Wire）和开关（Switch），门（Gate）也由开关组成。 线多了之后，看上去像网，所以Verilog里面的wire的Data Typ ...
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2018-09-06 02:55:13
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本博文参考：《大规模逻辑设计指导书》，对于写出规范的代码，培养良好的代码风格颇有裨益。 wire and register 一个reg变量只能在一个always语句中赋值； 这个说明至关重要啊，如果不满足这个，也许仿真的时候没问题，但是综合时候绝对出现，不可以综合。我就犯过多次这个错误。 曾经写过一 ...
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2018-08-30 01:55:16
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2018.07.17 https://en.wikipedia.org/wiki/Bus_(computing) 提到 Early computer buses were bundles of wire that attached computer memory and peripherals. A ...
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2018-07-17 14:22:01
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第2层交换机功能：1 1、基于硬件的桥接（ASIC） 2、线速（wire speed） 3、低延迟 4、低成本 第2层交换机和网桥的区别： 1、网桥是基于软件的，而交换机是基于硬件的，交换机使用ASIC芯片来帮助他们完成过滤决策； 2、交换机可以被视为多口网桥 3、每个网桥是有一个生成树实例，而交换 ...
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2018-07-16 23:09:51
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