近期，在项目中遇到了485总线干扰问题，问题表现如下： 1、在开发环境下，485通信完全正常，设备不掉线。 2、实际工作环境中，设备不断掉线，但也能不断重连上。 开发环境：普通工作环境 实际工作环境：周围具有较强的辐射干扰，由于辐射原因，传输出现干扰。 修改前电路： 1、485输出端常规的esd防护 ...
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2021-06-21 21:10:23
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举一个例子吧，比如你有一条水渠，原来只有一个水源头，后来你又开了一条水源流入这条水渠，那么你的水渠的水流量是不是大了，水量大了就可以灌溉更多农田，同样道理，电流也是这样。这就叫上拉。 一、上拉电阻如图所示： 1、概念：将一个不确定的信号，通过一个电阻与电源VCC相连，固定在高电平； 2、上拉是对器件 ...
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2020-07-27 09:33:31
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讲两个知识点。一个是关于上拉和下拉，另一个是关于threading函数。 1.上拉电阻和下拉电阻 上拉就是把一个不确定的信号通过一个电阻连接到高电位，这样在开关断开是信号为高电位，开关合上时信号为低电位。 同理，下拉就是把一个不确定的信号通过一个电阻连接到高电位。 "具体可以参考这篇博客" 2.th ...
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2020-05-10 01:22:12
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最近调试硬件，因为下拉电阻阻值问题导致某些板子能用，某些板子不能用，特此记录一下 电路呢，超级简单，就是如图所示，RF_DATA 是数据线，接到了ESP8266的GPIO13上，设置为上拉输入，既然内部上拉了（为什么外部又要下拉呢，因为之前测试的这个模块在输出低电平的时候，不能将电源完全拉到低，只能 ...
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2020-04-25 23:31:08
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GPIO_Mode_AIN 模拟输入 //一般用在ADC上GPIO_Mode_IN_FLOATING 浮空输入 //高低电平不确定，一般用在数据传输，读取电平高低、按键输入GPIO_Mode_IPD 下拉输入 //默认低电平，接下拉电阻GPIO_Mode_IPU 上拉输入 //默认高电平，接上拉电阻 ...
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2019-11-10 13:39:05
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上下拉电阻定义 1、上拉就是将不确定的信号通过一个电阻嵌位在高电平！电阻同时起限流作用！下拉同理 2、上拉是对器件注入电流，下拉是输出电流 3、弱强只是上拉电阻的阻值不同，没有什么严格区分 4、对于非集电极（或漏极）开路输出型电路（如普通门电路）提升电流和电压的能力是有限的，上拉电阻的功能主要是为集 ...
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2019-09-16 14:12:15
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GPIO框图剖析 基本结构分析 ①保护二极管及上、下拉电阻 当引脚电压高于VDD_FT 时， 上方的二极管导通，当引脚电压低于 VSS 时，下方的二极管导通，防止不正常电压引入芯片导致芯片烧毁。 通过上、下拉对应的开关配置，我们可以控制引脚默认状态的电压 ②P MOS 管和 N MOS 管 推挽输出 ...
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2019-07-18 19:29:54
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使用原因: 数字电路有三种状态：高电平、低电平、和高阻状态，有些应用场合不希望出现高阻状态，可以通过上拉电阻或下拉电阻的方式使处于稳定状态，具体视设计要求而定！ 一般说的是I/O端口，有的可以设置，有的不可以设置，有的是内置，有的是需要外接，I/O端口的输出类似于一个三极管的C，当C接通过一个电阻和 ...
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2018-11-09 10:51:31
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下面是在自己重新复习模拟电路和数字电路时的一些学习经验和想法、知识，分享出来一起学习！ 1、 HC为COMS电平，HCT为TTL电平 2、 LS输入开路为高电平，HC输入不允许开路， HC一般都要求有上下拉电阻来确定输入端无效时的电平。LS 却没有这个要求 3、 LS输出下拉强上拉弱，HC上拉下拉相 ...
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2018-09-22 12:51:56
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1. 先看下原理图，第一个问题，RS485其实就是使用的串口USART1，同时485的输出脚之间接120欧姆的电阻。 遇到个问题，为什么有两个使能引脚？还有RS485_A和RS485_B为什么分别接上拉和下拉电阻？ 2. 看下代码部分，主要是串口的初始化和串口的收发， 3. CCS的头文件和库文件加 ...
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2018-08-24 20:46:44
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