1.查看当前时间[root@localhost ~]# date2018年 03月 12日 星期一 22:32:44 CST2.修改系统时间(重启失效)[root@localhost ~]# date -s "2018-03-21 16:02:00"2018年 03月 21日 星期三 16:02:0 ...
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2020-04-07 18:46:31
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一、IIC基本概念 IIC 总线（I2C bus， Inter-IC bus）是一个双向的两线连续总线，提供集成电路（ICs）之间的通信线路。IIC总线是一种串行扩展技术，最早由Philips公司推出，广泛应用于电视，录像机和音频设备，IIC 总线的意思是“完成集成电路或功能单元之间信息交换的规范或 ...
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2020-04-06 12:10:22
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TMS320F2808芯片基本特点：高性能静态CMOS技术100MHz（10ns周期时间）60MHz（16.67ns周期时间）低功耗（1.8V内核，3.3VI/O）设计支持JTAG边界扫描IEEE标准1149.1-1990标准测试访问端口和边界扫描架构高性能32位CPU(TMS320C28x)16×16和32×32MAC操作16×16双MAC哈佛(Harvard)总线架构连动运算快速中断响应和处理
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2020-03-30 16:37:56
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基本常识： （1）Hot switch好的程序应避免使用热切换（这里热的含义类似于热插拔的“热“），热切换是指带点操作，有电流的情况下断开开关或闭合开关的瞬间，有电流通过，这会减少开关的寿命甚至直接损坏开关。 （2）Latch-up 闩锁效应，由于在信号，电源或地等管脚上施加了错误的电压，在CMOS ...
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2020-03-27 21:24:05
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任务16 BIOS与CMOS 任务描述：安装操作系统前，要进行硬件初始化设置。 任务实施过程： 一、BIOS基本概念：基本输入输出系统。BIOS芯片（ROM）保存内容如下。 自诊断程序：识别硬件配置，自检和初始化。 CMOS设置程序：用特殊热键启动，设置结果保存在CMOS的RAM中。 系统自举装载程 ...
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2020-03-23 20:44:28
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1、管脚兼容性设计 FPGA在芯片选择的时候尽量选择兼容性好的封装，那么在硬件设计时，就要考虑如何兼容多种芯片问题；在相同封装、兼容多个型号的FPGA设计中，一般原则是按照通用IO数量少的芯片来设计电路 2、根据电路布局来分配管脚功能 FPGA的通用IO管脚功能定义可以根据需要来指定，在电路图设计过 ...
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2020-03-17 22:34:50
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1 module tlv5618( 2 clk ,//50MHz时钟 3 rst_n ,//复位 4 dac_data ,//16位数据输入 5 start ,//DAC驱动使能 6 set_done ,//数据转换完成标志位 7 8 dac_cs_n ,//片选 9 dac_din ,//16数据 ...
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2020-03-15 13:31:21
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在我实际涉及的项目中，基本没有遇到多周期路径约束的情况，所以之前关注的不多，为了巩固基本知识，借此梳理这个约束。 1. 目的 目的就是说什么时候需要用到多周期约束？ Vivado、TimeQuest等时序引擎默认是按照单周期关系分析数据关系的，即数据在发起沿发送，在捕获被捕获，发起沿和捕获沿相差一个 ...
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2020-03-14 14:29:14
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程序代码: module uart_byte_rx( clk ,//50MHz时钟 rst_n ,//复位 baud_set ,//波特率设置 rs232_rx ,//rs232数据接收 data_byte ,//并行数据输出 rx_done //单个字节接收完标志 ); //参数定义s param ...
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2020-03-12 23:43:41
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以下知识是通过学习小梅哥FPGA后所总结的思路 USB转TTL电路图： UART发送端发送一个字节数据时序图： 对于其中的每一位进行采样，一般情况下每一位数据的中间点是最稳定的，因此一般应用中，采集中间时刻时的数据即可，如下图所示： 但是在工业应用中，往往有非常强的电磁干扰，只采样一次就作为该数据的 ...
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2020-03-12 18:49:10
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