在PCBA过程涉及到工序较多，每道工序都有可能发生质量缺陷，这些质量总是涉及到诸多方面，解决起来比较麻烦，由于产生问题的原因是多方面的，有的是属于化学、机械、板材、光学等等方面。经过几十年的生产实践，结合解决质量总是实际经验和有关的解决技术问题的相应资料，现总结归纳如下：
PCBA工序产生缺陷、原因和解决办法
工序 产生缺陷 产生原因 解决方法
贴膜 PCB板面膜层有浮泡 ...
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2014-08-21 11:37:04
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1.如果某个菜单被删除了，恢复方法：在菜单栏空白部分右击->customizing PCB Editor->toolbars->选中需要恢复的选项点击restore即可。2.键盘上的＋号键可以切换层。3.将板子切为keep out layer 的形状的方法：design->Board Shope->...
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2014-08-20 22:19:22
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AD基础使用： 1.建立一个工作区 （.DsnWrk） workspace 2.建立一个PCB工程(.PrjPCB) project 3.建立一个PCB原理图文件（理论上告诉你两个点连接起来） 建立原理图后需要编译一下，没问题再倒入pcb文件。(.SchDoc) schemmatic 4.建立一个P...
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2014-08-18 23:32:13
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今天把68013A-56焊接在CCD2的CPLD PCB上，配套的EEPROM存储器还没有焊接上，所以想用它试验一下Cypress的基础开发实例。研究了一上午，结果驱动都没装上。
我用一种我没想到的方式解决的这个问题，详见文章尾部叙述。
如果有人能给我一点提醒，非常感谢！Please contact...
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2014-08-18 12:58:52
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这个问题遇到几次了，每次都要在网上搜索解决方法，今天记下来！ 在规则里面不检查器件高度这项应该是最简单，也不影响其他规则的方法了！ 具体操作： Design - rules - Component Clearance ，把下图2的位置 勾选去掉！
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2014-08-18 10:32:53
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在差分对约束的情况下对差分对进行布线，实例下载地址：http://download.csdn.net/detail/wu20093346/7747837
（1）使用Allegro PCB SI GXL打开PCI5.brd。执行Display-Ratsnest，弹出Display-Ratsnest对话框。
（2）在Select By栏选择Net，在Net Filter输入LOOP*。
...
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2014-08-15 14:46:18
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其实我是大三了，做着自己学校的项目经理（管理加带人，帮助大一大二的孩子们早点接触所谓的技术，其实我本人也是刚刚在大三开始接触相应的技术的），嵌入式嘛！做底层开发肯定是需要制作相应的PCB板，针对此，我想说PCB板的制作，我开头使用的是PROTEL SE 99,不过它有个致命的缺点，那就是只能在XP上...
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2014-08-14 23:41:16
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建立差分对约束：
（1）设置差分对约束，从SigXplorer PCB SI GXL打开diff_sim.top拓扑。
（2）执行Setup-Constraints，弹出Set Topology Constraints对话框
（3）选择Diff Pair标签页，设置如图：
（4）单击OK，关闭对话框，File->Save，保存拓扑，File->Exit。
（5）应...
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2014-08-14 16:51:53
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对差分对仿真，首先要提取差分对的拓扑，然后对其进行仿真并对仿真结果进行分析。
（1）启动Allegro PCB SI GXL，打开D:\diffPair\PCI4.brd。
（2）执行Analyze->Preferences，弹出Analysis Preferences对话框。
（3）在InterconnectModels标签页设置Percent Manhattan为100，Defa...
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2014-08-14 10:50:28
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尽管目前半导体集成度越来越高，许多应用也都有随时可用的片上系统，同时许多功能强大且开箱即用的开发板也越来越可轻松获取，但许多使用案例中电子产品的应用仍然需要使用定制PCB。在一次性开发当中，即使一个普通的PCB都能发挥非常重要的作用。PCB是进行设计的物理平台，也是用于原始组件进行电子系统设计的.....
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2014-08-14 10:22:28
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