Floorplan包含： IO floorplan: 涉及板级设计、封装设计的交互，接口协议（timing相关），对一些高速接口需要做特殊考虑（如信号完整性等）。 Power plan：芯片的电源和低功耗设计方案、功耗及IR仿真。 Block floorplan：涉及设计结构，总线结构，时钟结构，数 ...
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2019-08-25 14:07:08
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为什么要引入AOCV 为了精确性，为了剔除悲观度。用set_timing_derate来设置OCV，对于一个固定的corner，只能对data/clock, cell/net, late/early分别设不同的值，由下图可知，这个值是个trade off的结果，在保证yield的前提下，尽量不那么悲 ...
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2019-08-22 01:21:51
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Timing sign-off Corner = library PVT +RC Corner + OCV 针对每个工艺结点，foundry都会给出一张类似的timing sign-off表格，定义了所有需要做timing sign-off的corner（实际需要sign-off的corner还需要 ...
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2019-08-22 01:02:55
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STA无疑是数字集成电路设计实现方法学中最『漂亮』的模型之一，但是随意着工艺进步，local varition 的随机性及重要性增加，传统STA 的局限性日渐突出。大概在十五年前，SSTA成了一个研究热点，相较于传统的STA，SSTA 不再是针对单一的timing 进行分析，它的分析结果是一个统计分 ...
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2019-08-22 00:51:19
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transition 动画效果 属性transition-xxx -duration ： 过渡时间 -property ： 过渡属性 width height backgroud-color none | all | property -timing-faction : 过渡方式 lnear 匀速 ...
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2019-08-21 23:04:30
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1.功能：模拟工艺偏差对芯片性能的影响 2. 40nm之前 flat derate模型可以基本覆盖大部分情况 3.AOCV （Adance OCV) 考虑distance 和depth的影响。 AOCV table背后已经有统计学的支撑,即SSTA(statistical static timing ...
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2019-08-21 13:33:50
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三部分：表头/launch path /capture path 1.表头 1） 工具版本信息：如示例中的18.10-p001，对某个具体项目timing signoff 工具的版本最好保证一致； 操作系统信息：这一项无关紧要。 生产日期：这一项还是有看一下的必要，避免低级错误，哼哧哼哧debug ...
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2019-08-21 00:22:10
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在Innovus中从ccopt 后的timing report中可以看到clock delay是从负值开始算起的，这个是因为在ccopt过程中进行了的update latency的动作。 基于block level的设计进行分析，假设在sdc中对clock 没有设置source&network la ...
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2019-08-21 00:21:51
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如何debug 一颗cell 或一段net 的delay, 常用的办法是用report_delay_calculation 报这颗cell 或这段net, 会得到形式如下的report, 从该report 中可以得到： 表头需要特别关注的是command, 确定report 的对象及加的option ...
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2019-08-21 00:12:24
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动画和变形 盒子动画 简单动画 渐变时间函数：transition-timing-function CSS属性以何种速度进行渐变 贝塞尔曲线：cubic-bezier 贝塞尔曲线是由四个参考点绘制而成的曲线 在CSS中，第一个点和第四个点已固定，用户可以设置第二和第三个点曲线的纵坐标表示渐变轨迹，横 ...
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2019-08-19 00:11:50
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