xapp1167与TRD14.4 关系
xapp1167与TRD14.4 都是学习zynq的最佳参考设计。都是基于ZC702，而不是zedboard的，如果要用zedboard那么必须修改硬件配置，因为在702板子中HDMI用的是软核，而zedboard中用的芯片，另外还有网卡等等都不一样配置也不一样。
1：xapp1167 :http:...
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2014-09-14 16:46:07
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1. 偏移约束的作用 偏移约束（Offset Constraint）用来定义一个外部时钟引脚（Pad）和数据输入输出引脚之间的时序关系，这种时序关系也被称为器件上的Pad-to-Setup或Clock-to-Out路径。这些约束对与外部元器件相连的接口十分重要，在这里，需要解释两个术语： Pad.....
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2014-09-13 23:58:56
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基于Vivado HLS在zedboard中的Sobel滤波算法实现
平台：zedboard + Webcam
工具：g++4.6 + VIVADO HLS + XILINX EDK + XILINX SDK
系统：ubuntu12.04
sobel 算法理论基础
流程
HLS算法验证与实现
算法验证包括算法C/C++实现，综合编译仿真，实...
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2014-09-13 21:31:35
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源：http://www.cnblogs.com/bingoo/p/3450850.html1.方法一：.sof和.elf全部保存在FPGA内，程序加载和运行也是在FPGA内部。把FPGA的配置文件.sof通过JTAG方式下载(其实是在线运行)进入FPGA本身，此时在NIOSII的界面中，点击“RU...
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移动开发 时间：
2014-09-13 11:58:35
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这几年一直在努力提高自己，从研究所出来后，由于工作的方向变了，自然就接触不了超大规模fpga了。也做不了fft和数字滤波器以及多相滤波等算法。转而在逻辑设计上更加深入的研究了。从千兆以太网的设计和mac的编写，以及sdram的另一种读写方式的研究，就是所谓的切换bank提高读写效率。 最近重新学习....
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2014-09-12 14:46:43
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今天心情还真是蛮ok，因为今天终于调出了正弦波，结束了快两三个星期的调试。但过程真是无语……...
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2014-09-11 09:42:31
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altera FPGA中的pin脚分配学问多，这里就看到的知识点做了一个汇总，希望后续还能补充
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2014-09-11 01:05:31
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介绍alteraFPGA中的pin做一个简要的说明
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2014-09-10 23:42:41
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1、异步复位
//异步复位
always @ (posedge clk or negedge i_rst)
if (!i_rst) begin
a <= 1'b0;
end
else begin
a <= 1'b1;
end
2、同步复位
//同步复位
always @ (posedge clk )
if (!i_rst) begin
b <= 1'b0;
end
else begin...
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2014-09-09 12:37:08
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224
