用例图：
类图：
这个类图中三个用户，有Generaluser、Opreator、Administrator都是对学生拥有的卡进行操作。
上下机活动图
时序图：
画好时序图后，按F5生成协作图
状态图：
组件图：
部署图：
这是机房UML画图中，画的几幅图，虽然现在有的图还不是很明...
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2015-01-10 10:04:51
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继上面介绍了setup文件的基本书写，简单介绍下时钟设置及简单地时序，面积，PVT设置约束。 DC的约束是基于路径的，这里所谓的路径起点是input port 或者clock port of flip-flop或者纯组合逻辑的寄存器输入，终点是output port或者任意时序逻辑的输入. 时钟：....
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2015-01-10 01:02:05
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建立一个时序调度程序的过程如下：
1) 配置Job及JobDetail Bean，定义执行某个类里的特定方法；
2) 配置Trigger Bean，定义触发JobDetail的时间规律；
3) 配置SchedulerFactoryBean负责调度实际的Trigger；时序调度的运行模式有两种：
1) 一种是在某个特定时间自动运行，例如每天凌晨2点备份数据、每...
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2015-01-09 15:37:55
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8.时钟初始化
ARM系统时钟初始化：
这就需要知道什么是时钟脉冲信号，什么是时钟频率，什么是时钟源。
时钟脉冲信号： 时钟脉冲信号：按一定的电压幅度，一定的时间间隔连续发出的脉冲信号。时钟脉冲信号是时序逻辑的基础，它用于决定逻辑单元中的状态何时更新。数字芯片中众多的晶体管都工作在开关状态，它们的导...
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2015-01-05 16:20:55
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Jetty 的启动过程
Jetty 的入口是 Server类，Server 类启动完成了，就代表 Jetty 能为你提供服务了。它到底能提供哪些服务，就要看 Server 类启动时都调用了其它组件的 start方法。从 Jetty 的配置文件我们可以发现，配置 Jetty 的过程就是将那些类配置到 Server 的过程。下面是 Jetty 的启动时序图：
图 4. Jetty 的启动流程...
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2014-12-30 15:18:28
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目前关于线程安全性没有一个统一的定义，作者自己总结了一个定义，如下：当多个线程访问某个类时，不管运行时环境采用何种调度方式或者这些线程将如何交替执行，并且在主调代码中不需要任何额外的同步或协调，这个类都能表现出正确的行为，那么就称这个类是线程安全的。在并发编程中，由于不恰当的执行时序而出现不确定的结...
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编程语言 时间：
2014-12-30 11:31:55
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以前在做一个项目中，算是我人生的第一个项目，在大四保研后跟着师兄做的，师兄选定方案、芯片和制作板子，我主要负责软件调试和测试。项目使用了一款TI的24位ADC，是ADS1247，与单片机通信采用的SPI，其实是模拟SPI时序，当时在网上查找了相关资料，发现资料太少了，而且例程也没有，但是调试其...
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2014-12-29 22:52:42
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1. 作为一种硬件描述语言，verilog可以直接描述硬件结构，也可以通过描述系统行为实现建模，其主要特点和功能有： *描述基本逻辑门和基本开关模型。* 允许用户定义基元。* 可以指定设计中的端口到端口的延时，路径时延和设计中的时序检查。 *可以采用多种方式进行建模，这些方式包括（1）顺序行为描述建...
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2014-12-29 19:49:20
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在实现反序列化的时候，上个DEMO直接将SQLconnection对象的创建写在了product的构造函数中，而在序列化时，再通过实现IDeserializationCallback接口重新创建SqlConnection对象，以此来还原对象状态。在Product构造函数和OnDeserialization()方法中，都硬编码了数据库连接字符串。
而更常见的情况时...
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2014-12-28 22:20:22
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8452是一款G-Sensor芯片，采用I2C跟主芯片通讯，采用中断方式跟操作系统协作。通过内部检测XYZ三个方向的加速度，实现各种应用。（1）原理框图如下： 现在来实现在WINCE中的I2C驱动，读写的时序波形图分别如下：读：写：基础写函数实现如下：static P_XLLP_OST_T ost_...
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2014-12-24 17:54:07
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