（时钟体系）时钟概念：★时钟脉冲：一个按一定电压幅度，一定时间间隔连续发出的脉冲信号；★时钟频率：在单位时间（如：1秒）内产生的时钟秒冲数；时钟的作用：时钟信号是时序逻辑的基础，它用于决定逻辑单元中的状态何时更新。数字芯片中众多的晶体管都工作在开关状态，它们的导通和关断动作无不是按照时钟信号的节奏进...
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2014-12-08 12:08:51
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最近在调试一个sensor，是基于ARM+FPGA构架的 8个sensor的一个全景拍照的平台。FPGA是EP3C25，基带处理芯片是海思的HI3518e。整个框架和原理设计都OK。后面就是调试sensor。
OV5640接口方式，我选用的是DC接口（数字摄像头标准接口，亦或叫DVP、CAMIF接口）。其中DC接口的标准时序是 ＰＣＬＫ，ＶＳ，ＨＳ，ＤＢ［７：０］。根据时序接口方式，调整PCLK...
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2014-12-05 17:33:48
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指令编码是指令惟一的标识，是指令相互区别的依据。所谓指令分析，最重要的就是识别指令，根据指令惟一的标识和时序节拍等，来确定这条指令应该如何动作。另外，每条指令所要完成的动作又都是有顺序的，这种顺序是用节拍变量来指示出来的。控制器就是能够识别指令，并且通过节拍来驱动每条指令完成相应必要动作的设备。
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2014-12-03 00:09:39
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最开始看的一些资料，大家其实讲得都差不多，但是我却看得云里雾里的，应该是还没真正理解这个东西。
今天心血来潮又把 《七天玩转ALTREA之时序篇》拿出来看了看，应该有些豁然开朗的感觉，在下实属愚笨，想透彻理解一个东西太慢。
首先看一下寄存器到寄存器的路径，如图1：
data arrive time：数据到达REG2.D的时刻。进行时序分析时，setup 和hold时间分析时的da...
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2014-12-02 20:55:37
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在FPGA的学习过程中，最简单最基本的实验应该就是分频器了。由于FPGA的晶振频率都是固定值，只能产生固定频率的时序信号，但是实际工程中我们需要各种各样不同频率的信号，这时候就需要对晶振产生的频率进行分频。比如如果FPGA芯片晶振的频率为50MHz，而我们希望得到1MHz的方波信号，那么就需要对晶振...
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2014-12-01 15:38:57
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从上到下，从左到右，高电平在上，低电平在下，高阻态在中间。双线表示可能高也可能低，视数据而定。交叉线表示状态的高低变化点，可以是高变低，也可以是低变高，也可以不变。 竖线是生命线，代表时序图的对象在一段时期内的存在，时序图中每个对象和底部中心都有一条垂直段的虚线，这就是对象的生命线，对象的消息...
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2014-12-01 12:42:11
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现在知道时序约束主要是FPGA to ic，或者ic to FPGA。上图可以表示FPGA to IC, IC to FPGA.fpga2ic：fpga2ext 是 fpga 致 ic 信号的走线延迟；clk2fpga 是时钟信号致 fpga 的走线延迟；clk2ext 是时钟信号致 fpga 的走...
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2014-11-30 13:42:13
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作者：Andrew Huangbluedrum@163.com驱动数字电路运转是的时钟信号，时序电路都需要一个外部时钟信号来驱动，完成计时，同步,计数,时序控制等各种功能。象CPU也是用时序信号驱动来完成各种运算的，而且象ARM带的模块绝大部分与时序都有关，因此理解时钟信号对于底层编程非常重要。一....
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2014-11-27 12:08:31
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序列化是指一个对象的实例可以被保存，保存成一个二进制串，当然，一旦被保存成二进制串，那么也可以保存成文本串了。比如，一个计数器，数值为2，我们可以用字符串“2”表示。如果有个对象，叫做connter，当前值为2，那么可以序列化成“2”，反向的，也可以从“2”得到值为2的计数器实例。这样，关机时序列化...
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2014-11-27 10:29:00
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时序图是用来描述对象的状态（或某数值）随时间变化而变化的图，一般软件开发中很少会用到。灯有开和关两种状态，随着时间的推移，期间有人去开或者关这个灯，用时序图表示如下：注意：蓝色和红色圈圈、黄色底色的文字不是时序图的一部分，仅是用来说明。本图分上下两部分，上部分是以折线的方式来表示Light的状态变化...
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2014-11-26 16:09:45
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