一、boot启动： 1.硬件资源： 64KB rom 用于完成以下工作：Pre-boot tasks ° Clean PMU RAM ° Enable the System Monitor and check LP domain supply. ° Configure PLLs with initi ...
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2017-07-04 21:42:21
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xilinx公司的FPGA种类繁多，知道了命名规则，看起来应该会舒服很多。 1.xilinx的FPGA命名规则Xilinx的ug112第一章中介绍了Xilinx公司的FPGA命名规则。一般而言，大的FPGA的上表面是这个样子的。 譬如，对于编号为XC4VLX60-10FFG668CS2的FPGA，器 ...
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2017-07-02 19:42:49
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Edit → language templates ： 打开即可查看基本语法。 一、xilinx中的约束文件 1、约束的分类 利用FPGA进行系统设计常用的约束主要分为3类。 （1）时序约束：主要用于规范设计的时序行为，表达设计者期望满足的时序条件，知道综合和布局布线阶段的优化算法等。 （2）布局布 ...
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2017-07-01 13:37:44
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问题1：.lic无法打开 打开：C:\Xilinx\14.6\ISE_DS\ISE\lib\nt64 思路是这样： 将libPortability.dll重命名（加尾缀.orig,意思是original，就是保存原文件） 将libPortabilityNOSH.dll复制粘贴，并将该副本重命名为li ...
PUDC_B管脚用途 Pull-Up During Configuration (bar) Active-Low PUDC_B input enables internal pull-up resistors on the SelectIO pins after power-up and durin ...
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2017-06-23 00:48:27
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xapp1078创建于2013年2月。文章描述了启动运行两个内核的方法，两个cpu内核分别运行linux和bare-metal。已经过去四年，所以称其为传统的AMP方案。 该方案的关键过程： （1）修改FSBL源码，使其能够load多个elf和bit文件，直到遇到标志Load地址后停止load，返回 ...
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2017-06-15 17:15:11
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在上一篇博文中，研究了xapp1078，它的目标平台是zc702。本文分析在zc706实现AMP时需要修改的关键点。参考资料：http://www.wiki.xilinx.com/XAPP1078+Latest+Information 1，zc706中的bootROM中，采用了V2版本。该版本使用了 ...
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2017-06-14 23:31:21
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? 最新消息请看最后~ 我的任务是分析Verilog程序中的算法...于是自然搭配Xilinx(赛灵思)发布的vivado集成开发环境进行分析.我用的版本是vivado 2017.1版本,在这之前,2014.4版本总是会出现各种奇怪的错误...比如编译时出现: [Vivado 12-1345] Er ...
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2017-06-04 14:41:44
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在配置xilinx的交叉编译工具以及source settings64.sh时，出现如下错误提示： awk: symbol lookup error: awk: undefined symbol: mpfr_z_sub 解决过程： 通过strace awk source settings64.sh发 ...
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2017-05-27 17:06:58
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Xilinx FPGA开发环境vivado使用流程 1.启动vivado 2016.1 2.选择Create New Project 3.指定工程名字和工程存放目录 4.选择RTL Project 5.选择FPGA设备 6.工程创建完成后 7.开始编写verilog代码 第一步：点击Add Sour ...
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2017-05-10 19:57:49
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