上一节说到了DDR寻址的问题，如下图： 从官方文档上我们看到了DDR的地址是从0008_0000开始的，那么我们开始修改Xilinx给我们提供的IP核代码。其实很简单，上一节已经分析了地址停留在0000_1000的原因，现在我们只需要把write_burst_counter的位宽变大就可以了。 从上 ...
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2016-07-20 22:44:25
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虽然Xilinx已经将和AXI时序有关的细节都封装起来，给出了官方IP和向导生成自定义IP，用户只需要关注自己的逻辑实现，但是还是有必要简单了解一下AXI的时序，毕竟咱是做硬件设计的。 AXI（Advanced eXtensible Interface）是一种总线协议，该协议是ARM公司提出的AMB ...
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2016-07-16 22:38:27
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解决Xilinx_ISE在Win8下打开崩溃闪退的方法 解决Xilinx_ISE在Win8下打开崩溃闪退的方法 在64位windows8或者8.1上安装xilinx ise之后，加载 licence或者保存文件的时候，ise应用程序就会崩溃，出现闪退的情况。 修复方法： 第一步： 找到xilinx安 ...
FPGA DDR3调试 Spartan6 FPGA芯片中集成了MCB硬核，它可以支持到DDR3。在Xilinx的开发工具Xilinx ISE中提供了MIG IP核，设计者可以用它来直接生成 DDR3 控制器设计模块，并通过 MIG 的 GUI 图形界面完成相关配置。 首先，建立ISE工程，并添加MI ...
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2016-07-06 20:15:44
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利用FPGA调试光纤接口接口： 由于与项目需要，前段时间调试了光纤接口，记录一些设计经验。 设计中采用FPGA控制光纤模块完成光纤数据的收发，FPGA采用Xilinx公司的Spartan6 LX45T，由于其内部自带的2个GTP收发器，能作为多种高速通信协议（千兆以太网、PCI-E，SATA等）的桥 ...
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2016-07-06 18:23:25
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摘自:《xilinx FPGA 开发实用教程》 1）被除数重复的减去除数，直到检测到余数小于除数为止,优点：对于除数与被除数相差较小的情况下合适 2）通过如下图片方式实现+状态机。优点：挺好的自己用硬件实现的方法 3）通过FPGA自带的DSP实现，即直接使用"/"，优点：速度快 4）用FPGA自带的 ...
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2016-06-11 17:18:18
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上篇文章实现了了PS接受来自PL的中断，本片文章将在ZYNQ的纯PS里实现私有定时器中断。每个一秒中断一次，在中断函数里计数加1，通过串口打印输出。 *本文所使用的开发板是Miz702(兼容zedboard) PC 开发环境版本：Vivado 2015.2 Xilinx SDK 2015.2* 中断 ...
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2016-06-09 18:33:48
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本篇文章主要介绍外设（PL）产生的中断请求，在PS端进行处理。 在PL端通过按键产生中断，PS接受到之后点亮相应的LED. 本文所使用的开发板是zedboardPC 开发环境版本：Vivado 2015.4 Xilinx SDK 2015.4 搭建硬件工程 建好工程后，添加ZYNQ IP 双击 ZY ...
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2016-06-09 17:14:14
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最近项目需要用到差分信号传输，于是看了一下FPGA上差分信号的使用。Xilinx FPGA中，主要通过原语实现差分信号的收发：OBUFDS（差分输出BUF），IBUFDS（差分输入BUF）。 注意在分配引脚时，只需要分配SIGNAL_P的引脚，SIGNAL_N会自动连接到相应差分对引脚上；若没有使用 ...
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2016-06-06 21:49:30
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xilinx vdma详解，包括仿真和综合应用...
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2016-06-06 01:13:31
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