一、概述 用Altera的话来说，TimeQuest Timing Analyzer是一个功能强大的，ASIC-style的时序分析工具。采用工业标准--SDC(synopsys design contraints)--的约束、分析和报告方法来验证你的设计是否满足时序设计的要求。本文中，将采用一个D...
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2015-04-05 18:41:23
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chip planner中一个io的结构如下图所示其中左边是输出部分右边是输入部分，但是会注意到两个结构：1，寄存器，2，delay模块以下是我的推测：这两个结构是为了做时序优化时用的，在altera提供的时序优化文档中提到有快速输入输出寄存器在io cell里。如果有正确的时序约束的话，quart...
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2015-04-02 14:57:49
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异步SRAM：正如其名，不是与特定的时钟信号同步运行，而是根据输入信号的状态运行的。因为没有信号表明读取时已确定了有效数据，也没有信号表明写入时已接收到数据，所以，需要获取制造商的数据手册，根据时序图，按“应该已读出有效数据”及“应该能接收数据”这样的条件，进行存储器的设计。1. 读操作：OE读控制...
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2015-04-01 19:09:51
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PMC®公司近日发布了一款基于OTN的解决方案，该方案适用于LTE和LTE-Advanced系统中的集中式基带RAN（C-RAN）架构。迄今为止，繁复的延迟及时序上的要求 使C-RAN的部署一直处于停滞状态。PMC提供的方案不仅能满足延迟上的要求，提供的抖动水平更是优于要求达75%，使得OTN得以用于实现电信级的前端回传方案。...
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2015-04-01 09:40:51
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这种情况是指在后台处理一个HTTP Post命令时将时序重新交给浏览器端，然后运行javascript，然后再回到服务器端，然后继续进行后边的操作。如果你会画时序图，就可以发现这种有着两个来回通讯的程序比大多数所知道的那种只有一个来回的通讯的程序要复杂（虽然代码并不多多少）。这里用到.NET的IPo...
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2015-03-30 12:37:49
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机房重构画图是一个非常重要的一个阶段，机房重构之前也画过UML的图，但是这一次与上一次不同，这一次有分层的思想在里面。
包图
之前三层的时候各层之间的传递很清晰，包图也很容易就画出来了，先来看之前三层的包图。通过实体将输入的信息从U层传入B层，同时通过实体将信息从D层传入B层，B层进行判断，通过实体将结果返回给U层。
之前的三层不能很好的实现低耦和的思想，并且我们学习了设计模式，要继...
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2015-03-28 23:20:24
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第四章 时序图
一般来说，我们会在一张时序图中画出某个情节的相关行为，图种会秀出这个使用案例（use case）里面可能出现的一些对象，以及在对象间传送的信息。
本章将通过一个简单情节，做时序图各方面的相关讨论。假设我们现在有一份订单，并且准备调用它的一个命令，算出这份订单的价格。为了达到这个目的，订单需要产看它里面所拥有的一些订单明细、决定它们的价格，价格决定方式是以订...
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2015-03-21 23:02:39
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众所周知，Webkit需要创建DOM树。为此它需要创建WebView， Chrome，Page，Frame， Document， Document Parser， DOM Tree Builder（DOM树的建造引擎），ScriptRunner， Resource Handle等等对象。
同时，还需要创建为上面这些对象服务或者与之通信的支持对象，比如：与本地窗口相关的ChromeClient， 与FrameLoader事件相关的FrameLoaderClient，为Document服务的D...
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2015-03-20 12:53:53
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本文介绍在EA工具中，从最初的用例延续下来，先设计类及其方法，再设计时序图过程，以及时序图分层设计方法。...
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2015-03-20 00:05:57
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