错误现象： 原因分析： \u-boot-xlnx-xilinx-v2018.1\u-boot-xlnx-xilinx-v2018.1\drivers\mtd\spi\ spi_flash.c中 static const struct spi_flash_info *spi_flash_read_id ...
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2020-10-30 12:16:08
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硬件情况 使用的是DS1338这款RTC时钟芯片，I2C总线对应到PS端的I2C1。 配置 内核 添加有关的驱动： 因为DS1338用的驱动与DS13307相似，一找发现是同一个配置。 CONFIG_RTC_DRV_DS1307 Device Drivers > [*] Real Time Cloc ...
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2020-10-18 09:36:09
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Xilinx MPSoC PS/PL之间的数据交互和外设设计 1. 作者 付汉杰 hankf@xilinx.com 2020-09-10 2. 概述 MPSoC是Xilinx基于16nm工艺推出的异构计算平台，由于灵活、稳定，在业界得到了广泛的使用。异构计算是一个比较新的领域，需要协调硬件设计、逻辑 ...
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2020-09-17 20:55:39
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PYNQ社区项目 http://www.pynq.io/embedded.html PYNQ硬件加速图像缩放--实例 https://github.com/Xilinx/PYNQ-HelloWorld PYNQ-视频加速器 https://github.com/Pieter-Berteloot/PY ...
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2020-07-30 14:41:02
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zynq之TF卡写入常见问题 1、基本原理 前面做过zynq的TF读写实验，使用串口返回了实验所需的现象。那个时候也没有深究头文件"ff.h"里的几个常用的函数。这次需要使用TF卡做实验时发现很多操作都不大一样，不能够简单的重复，这里把几个常见的问题列举出来，方便以后的查阅。 2、实际问题 先用一段 ...
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2020-07-30 01:52:02
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FPGA的时钟资源介绍主要分为三部分。第一部分是区域结构，第二部分是元件功能，第三部分是实现方式。 首先FPGA的时钟资源负责驱动所有的时序逻辑，生产商尽力使得时钟资源充分，可靠，为了达成这一目的，xilinx采取了结构化的时钟资源布局方式。 首先将整个板子分为左右两部分，宽度完全一致，中间是大动脉 ...
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2020-07-29 17:33:45
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设计工具功能 Vivado IDE 是用于创建SoC 设计中硬件系统部分的一个集成开发环境，例如可创建处理器，存储器，外设，扩展接口和总线。Vivado IDE 和设计套件中的其他工具有交互，并且包含集成和打包IP 的工具，这种设计为工程的可重用性提供了可能。 SDK 是基于广受欢迎的Eclipse ...
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2020-07-16 22:03:38
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最近FPGA需要用到大量的矩阵运算，需要使用多个shift_RAM对数据进行缓存，考虑到资源消耗问题，做相关记录。 一、LUTRAM和 BRAM在资源使用上的区别？ LUTRAM 和 BRAM最主要的却别在于 LUTRAM是使用的没有综合的LUT单元生成的动态RAM，在Design中使用 多少，综合 ...
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2020-07-15 15:12:07
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Xilinx Zynq FPGA Boards板 Xilinx Zynq FPGA Boards 介绍 Styx是一个易于使用的Zynq开发模块，具有Xilinx的Zynq ZC7020 SoC和FTDI的FT2232H双通道USB设备。Xilinx的Zynq系列集成电路采用了一个ARM核的硬件片上 ...
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2020-07-04 11:39:04
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petalinux 2019.2里面不包含 aarch64-linux-gnu-gcc 从petalinux 2018.3 里拷贝过来 路径： /tools/linux-i386/aarch64-linux-gnu 或者也可以用gcc-linaro-7.5.0-2019.12-x86_64_aarc ...
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2020-07-01 20:42:20
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