在Tcl Console中输入如下命令： set_param general.maxThreads 8 检查是否设置成功： get_param general.maxThreads “跑分”试验如下： 主机配置： 工程一： Vivado版本：2018.3 FPGA型号：xc7z100ffg900-2 ...
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编程语言 时间：
2021-01-01 11:56:34
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设计工具功能 Vivado IDE 是用于创建SoC 设计中硬件系统部分的一个集成开发环境，例如可创建处理器，存储器，外设，扩展接口和总线。Vivado IDE 和设计套件中的其他工具有交互，并且包含集成和打包IP 的工具，这种设计为工程的可重用性提供了可能。 SDK 是基于广受欢迎的Eclipse ...
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2020-07-16 22:03:38
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最近遇到一个现象，以前可以编译通过的工程，修改之后发现Synthesis编译报错，而且没有给出error信息，以前也出现过无故place 失败但是没有给出error信息的现象，查看错误日志输出文件，出现# # An unexpected error has occurred (EXCEPTION_A ...
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2020-07-06 10:45:49
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关于DDR3仿真平台的搭建，首先我们要了解DDR3IP盒子。DDR3的IP盒子是MIG。在我们使用MIG的时候，他所出的位置及其作用我们必须了解。也就是他所出在我们控制的什么位置。如下图所示： MIG控制器也就是IP盒子，所处的位置是连接我们用户逻辑和DDR3芯片的中间控制器。其实大多数IP都是一端 ...
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2020-07-06 01:27:32
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一、HDMI接口的简要介绍 最先接触到的时ＶＧＡ那么两者有什么区别呢？主要区别如下： １、HDMI接口：是数字信号接口，可传输音频和视频，硬件接口较小，支持热插拔。 2、VGA接口：是模拟信号接口，只可传输视频流数据，硬件接口较大，虽说不支持热插拔，但是也没什么问题，损坏显卡而已。 HDMI接口就是 ...
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2020-06-27 13:19:20
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Vivado：2016.4 Linux：Ubuntu16.4 ZYNQ：xc7z020 题主最近在做ZYNQ的网络接收，需求是4路百兆网输入，PS自带的两个网口肯定不够用，于是在PL侧外扩了3个百兆以太网（参见之前博文：ZYNQ Linux 下 AXI Ethernet使用记录），一切运行正常后测试 ...
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2020-06-26 12:20:28
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基于AXI4的自定义IP核的设计 1、实验目标 利用vivado中内置的AXI总线初始化的IP核设计工具，将自己设计的流水灯的PL代码打包成IP核外设，挂在PS上，通过PS上的按钮控制流水灯的开始和结束。 2、实验原理 首先准备一个流水灯的代码，打包到AXI为基础的核上。然后利用PS访问这个部分并且 ...
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2020-06-24 23:48:11
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vivado中的VIO调试工具的使用 1、实验原理 前面一篇介绍了ILA的独立测试，vivado中还有其他的FPGA测试工具。其中VIO就是个比较常用的工具。相对于ILA更多的关注波形，VIO则专注于输入和输出关系的描述。个人理解为VIO就是一个便携测试，可以根据输入测试输出。VIO提供按键仿真和L ...
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2020-06-23 21:48:04
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vivado非嵌入ILA的使用 1、实验原理 前面在vivado中联合vitis设计时接触过ila，那个时候采用的方法是直接调用IP核在原理图中连接。这个方法简单直接，可以将自己所需的测量信号转移到ILA上实现显示。在下载后会自动弹出ILA界面。但是，这个方法在后期需要手动修改设计，将ILA移除。不 ...
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2020-06-21 23:35:42
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报错如下 [Drc 23-20] Rule violation (NSTD-1) Unspecified I/O Standard - 4 out of 142 logical ports use I/O standard (IOSTANDARD) value 'DEFAULT', instead ...
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2020-06-16 18:44:43
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