Quartus里面的ROM IP核进行内容分配，需要在Wizard里面指定.mif文件。 本文有关细节和详细说明，请参照Quartus Prime 帮助文档v15.1 一个常见的mif文件如下所示： 说明：1、可以用%%完成多行注释，两个百分号之间的内容是注释内容。 2、除了CONTENT BEGI ...
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2019-07-28 20:19:01
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对常用的FIR，我们使用MATLAB的fdatool（或者filterDesigner） 设计滤波器，给定指标，生成系数。为了方便，我们将系数保存到文件，其保存格式比较简介，在此进行说明。 1、FIR II可以读取的文件，格式为系数+逗号，例如下面的3个系数的文件： 2、注意事项： （1）逗号后面不 ...
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2019-07-22 16:35:57
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这几天从一个老师那里得到了一个代码，让我调试一下，一开始代码编译过后无法生成一个全新的 .sof 文件，我就先将代码中原有的 **.sof 文件移出 Quartus 工程下的 output_file 文件夹，然后进行编译，发现还是无法生成一个 **.sof 文件，然后我就删除了Quartus 工程下 ...
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2019-06-04 09:24:15
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在modelSIM的wave界面，按Ctrl + S，可以保存.do文件，里面有显示波形的命令，结合其他指令，可以协助Quartus进行仿真。 Quartus的工程设置中，EDA Tool Setting ->Simulation ->NativeLink Settings允许指定.do或者.tcl ...
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2019-03-29 19:03:50
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晚上写了一个简易的信号发生器的程序，上机验证成功，通过了 Signal Tap II验证。 Mif 文件的数据是通过 mif_maker2010 这个软件生成的，它的使用教程通过这个链接可以找到：https://www.cnblogs.com/qidaiymm/p/6007704.html 硬件环境 ...
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2019-03-22 22:40:50
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本实验使用DE1器件，cyloneV，主要做的基础实验，目的是回顾前期的学习和巩固知识和熟悉操作流程。 初学者FPGA开发流程： 1、设计定义; 2、设计输入；（quartus II） 3、语法检测，分析和综合（quartus II检查）； 4、功能仿真；（modelsim-altera仿真） 5、 ...
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2019-02-21 13:03:48
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摘要：虽然网上有很多fir的使用博客，但是呢？本文的fir是基于最新的IP核 fir II 来说的。在新版的软件中，搜索fir只剩下fir II 了。。。本文仅说明该IP的参数怎么设置，如何使用，在此笔者已经验证过了，大家可以自行到硬件上验证。 ...
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2019-01-04 17:16:16
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fpga存储图像方案讨论 本文不讨论片上ram 以及sram存储，在此进讨论基于sdram存储的情况，在此sdram指 sdr sdram ，ddr sdram ， ddr2 sdram ，ddr3 sdram等。 （——不用对这些sdram感到惧怕，在quartus中都可以生成他们的IP核，而对用 ...
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2018-12-30 02:57:33
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Verilog 常见错误汇总 1.Found clock-sensitive change during active clock edge at time <time> on register "<name>" 原因:vector source file中时钟敏感信号(如:数据,允许端,清零,同步 ...
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2018-11-30 11:22:57
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如果我们直接用Modelsim SE仿真 Altera IP核，首先会进入Quartus II目录下找到IP核对应的仿真库源文件，然后在Modelsim SE中进行编译，添加到Modelsim SE的仿真库中，在仿真对Altera IP核进行仿真时，然后选择对应的仿真库，才可以正常进行仿真。 然而， ...
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2018-11-28 23:36:58
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