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搜索关键字:timescale    ( 64个结果
Verilog篇(三)仿真原理
首先引入一个例子:`timescale 1ns/100psmodule TB; module INV_DFF(Clock, Reset_n, DataIn, DataOut);reg Ck, Rst_n, Din; input Clock;wire Dout; input Reset_n;//Clo...
分类:其他好文   时间:2015-04-06 15:39:14    阅读次数:218
timeScale减速对动画影响的处理方法(转)
《刀塔传奇》相信做游戏开发的都知道,如果不知道说明你是一个闭关修炼的千年老妖怪了哈哈哈在此开个小小玩笑,现在步入正题在《刀塔传奇》中,某个角色在释放技能的时候,其他所有角色以及怪物的动画,特效全部都会停止下来。当角色的技能全部放完,整个画面才恢复正常。为了实现以上功能我通过网上收集以及自己摸索整理出...
分类:其他好文   时间:2015-03-06 18:35:51    阅读次数:801
led
(1)自加LED显示代码 本模块用于检测或者验证LED的电路,以及性能,一般人都会用到。//`timescale 1ns/1ns module led_addr_display#(parameter LED_WIDTH = 8)( //global clock input clk,input r.....
分类:其他好文   时间:2015-01-13 19:42:57    阅读次数:131
四位计数器
1 同步复位异步复位指复位不受时钟控制,但其他操作仍然与clk有关;同步复位指复位信号和时钟同步。2 四位计数器的电路运行流程图 1)计数器verilog代码`timescale 1ns/1nsmodule count4(out,reset,clk); input reset,clk; ou...
分类:其他好文   时间:2015-01-07 20:29:27    阅读次数:268
Verilog学习笔记
1.用Forever循环和disable实现5到67的计数器。 1 `timescale 1ps/1ps 2 module tst5_25(); 3 reg clk; 4 reg [7:0]count; 5 6 initial fork:CNT 7 clk = 0; 8 count = 5...
分类:其他好文   时间:2014-11-25 16:04:13    阅读次数:196
Zynq学习笔记(1)
做硬件的第一个实例,一般当然是LED点灯啦~ 硬件:ZedBoard 软件:ISE 14.7 1、新建工程 2、选择平台 3、新建完成后,输入如下代码: `timescale 1ns / 1ps ////////////////////////////////////////////////////...
分类:其他好文   时间:2014-11-23 20:08:03    阅读次数:264
任意整数分频Verilog(占空比50%)
程序实现任意整数分频的功能,已在modelsi`timescale 1ns/1nsmodule div_N_tb;reg CLK,rst;wire CLK_div_N;div_N U1(.CLK(CLK),.CLK_div_N(CLK_div_N),.rst(rst));initialbeginCL...
分类:其他好文   时间:2014-10-23 17:38:28    阅读次数:145
FPGA六位共阳极数码管动态显示
1 `timescale 1ns/1ps 2 module adc_dis( 3 clk , 4 rst_n , 5 sm_seg , 6 ...
分类:其他好文   时间:2014-10-23 09:16:32    阅读次数:251
测试代码
1 `timescale 1ns / 1ps 2 ////////////////////////////////////////////////////////////////////////////////// 3 // Company: 4 // Engineer: 5 // ...
分类:其他好文   时间:2014-10-18 01:53:50    阅读次数:311
Sdram控制器
/* desctription: this module implement the sdr_sdram timing. the author:lufy yin(wuqingjianke) */`timescale 1ns/1psmodule sdram_io #(parameter DataWid...
分类:其他好文   时间:2014-08-24 12:52:42    阅读次数:208
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