有幸得到米尔电子zynq系列开发板Z-turnBoard试用体验，下面说说我这款zynq系列的Z-TURN板子外设配置。从Z-turnBoard原理图上看，目前可以配置的FPGA管脚大概有100多个，其它的管脚全部分配到A9上面，我用ISE14.6配置了几个通信接口，然后生成API接口，目前ARM端在裸机跑程序，后续上操作系统试试网口的通信功能，图中红色的圈即为配置的外设通信口。
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2019-08-07 12:12:43
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1.硬件平台搭建在BlockDesign里添加ZYNQ7ProcessingSystem和AXI_GPIO模块，双击AXI_GPIO设置为输出，驱动外部IO器件(如LED)。搭建好的系统结构如下图所示：2.软件SDK设计SDK软件设计可以参考官方设计文档，主要API函数有，intXGpio_Initialize(XGpio*InstancePtr,u16DeviceId)voidXGpio_Set
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2019-08-07 12:10:35
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1.AXI4通道读地址通道(Readaddresschannel,AR)写地址通道(Writeaddresschannel,AW)读数据通道(Readdatachannel,R)写数据通道(Writedatachannel,W)写响应通道(Writeresponsechannel,B)每个通道由一个信号构成，并且使用双向的VALID和READY握手信号机制。2.AXI4信号定义3.AXI4读写波形
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2019-08-01 10:10:53
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1.硬核处理器与软核处理器在芯片内的硅片上通过划分一定的区域来实现处理器功能称为硬核处理器。在一些对处理器性能要求不高的场合，通过使用FPGA内部资源搭建一个处理器功能称为软核处理器。如果采用硬核处理器，整个芯片的成本会较高，且灵活性相对较差，但性能较高。如果采用软核处理器，成本较低，同时灵活性较高，但性能较低。2.Zynq-7000SOC功能结构Zynq-7000由PS(ProcessingSy
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2019-07-30 13:00:26
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将错误窗口关闭， 双击Boundary Scan，跳出窗口”Do you want to continue and ...”直接关闭， 再跳出一个窗口“This device supports attached Flash PROM .....“窗口再直接关闭，再点击图示的SPI/BPI接口添加.m ...
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2019-07-28 17:43:37
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早就听闻XILINX新一代SOC，ZynqUltraScale+MPSOC系列性能强悍无比，号称相比ZYNQ7000系列每瓦性能提升5倍，一直未能体验一把。直到近期因项目需要，入手了一套米尔的MPSOC开发板，才终于开启了MPSOC学习之路。废话不说，helloworld先。开发环境：vivado2017.4，开发板型号：米尔MYD-CZU3EG，主芯片XCZU3EG-1SFVC784。这个MPS
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2019-07-24 09:51:11
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需要在上电USB枚举过程中通过fxload下载固件到USB Cable，然后重新枚举加载驱动。系统需要安装fxload工具，在Xilinx Vivado/ISE安装目录下找到固件文件xusb*.hex复制到/usr/share下，然后创建如下udev rules文件。 # Xilinx USB Ca ...
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2019-07-05 00:21:03
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第一步：使用WinDriver生成驱动 1.运行Drier Wizard 2.点击New host driverproject 3.在列表中，选择待安装驱动的设备，这里选择基于PCI的Xilinx数据采集卡 4.点击Generate .INF file控件 5.在弹出的口中，可以看到待安装驱动的设备 ...
~/Xilinx/.xinstall/Vivado_2015.4$ sudo ./xsetup -help Running in batch mode... Copyright (c) 1986-2019 Xilinx, Inc. All rights reserved. usage: xsetup... ...
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2019-06-24 12:14:57
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project: https://github.com/Xilinx/HLx_Examples/tree/master/Acceleration/tcp_iptool version: vivado and vivado_hls is 2015.4compile problems:1.run mak ...
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2019-06-23 19:08:02
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